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FPGA ------- 基于FPGA数码管设计

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发表于 2019-6-24 14:05 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我们先分析要实现的功能,数码管0显示数字0,翻译成信号就是seg_sel的值为8’b1111_1110,seg_ment的值为7’b000_0001。数码管1显示数字1,也就是说seg_sel的值为8’b1111_1101,seg_ment的值为7’b100_1111。以此类推,数码管7显示数字7,就是seg_sel的值为8’b0111_1111,seg_ment的值为7’b000_1111。
( B) E0 W* M( i2 ]4 n5 }/ I再留意下,以上都是每隔1秒进行变化,并且是8个数码管轮流显示。, U. S/ Z0 c: V# S
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