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Xilinx-7Series-FPGA高速收发器之TX发送端介绍(1)

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发表于 2019-6-13 14:02 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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每一个收发器拥有一个独立的发送端,发送端有PMA(Physical Media Attachment,物理媒介适配层)和PCS(PhysicalCoding Sublayer,物理编码子层)组成,其中PMA子层包含高速串并转换(Serdes)、预/后加重、接收均衡、时钟发生器及时钟恢复等电路。PCS子层包含8B/10B编解码、缓冲区、通道绑定和时钟修正等电路。对于GTX的发送端来说,结构如图1所示。# F- M8 @: D7 W5 E# v

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