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FPGA ------- 状态机模型之Mealy型状态机 1型

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发表于 2019-6-11 11:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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上篇博文讲了:Moore型状态机,这篇博文和上篇博文思路一致,如果读懂了上篇博文,这篇博文就很容易理解了。5 o8 r; z  R5 I, T$ Q# X
- m: H" ?! |- i# F0 c
5 ~7 ?( ^7 M$ a
如果一个状态机的输出是由现态和输入共同决定的,那么它就是一个Mealy型的状态机。而按照驱动输出的数字电路特性,又将Mealy型状态机细分为Mealy 1型、Mealy 2型、Mealy 3型,详细介绍如下:
# T$ ^5 \- @& `
2 r. Y0 q* b4 e4 D' A# O1 ]$ w

, ?( A/ }  @# `( @$ wMealy 1型
1 z6 |: L2 M8 m% \6 n2 H; z
: n* v/ g) D7 `/ t8 `& I
# s! e) L: x) L3 f( P; A+ F: w
Mealy 1型状态机的原理框图如下图1所示:
# @4 f7 l4 p2 w( U/ h4 p2 Y* o- P
. r) H3 y+ I1 h" Y! J* I, T+ j
  {) Y$ p1 r4 v: E/ ~
游客,如果您要查看本帖隐藏内容请回复

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! A& o+ E: G+ Z4 `* e- _6 I
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6 R0 v" v$ C5 p/ n& L$ _: J

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发表于 2019-6-11 16:46 | 只看该作者
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