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FPGA ------- 调试设计的指导原则

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发表于 2019-6-6 15:11 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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对于FPGA调试,主要以Intel FPGA为例,在win10 Quartus ii 17.0环境下进行仿真和调试,开发板类型EP4CE15F17。主要包括一下几个部分:
1 W9 H" Q2 W" l( L
$ }. v( }3 u4 r5 s. N- FPGA的调试-虚拟JTAG(Virtual JTAG)1 @, a" z' s/ J8 A0 J
' h3 H; `7 }: O, O9 h/ u  y
- FPGA的调试-在线存储器内容编辑工具(In-system Memory Content Editor)
$ W  H) c2 E( u. k8 ]! Q8 \9 f; q
9 ]& a5 p4 s/ f. _4 k- FPGA的调试-内嵌逻辑分析仪(SignalTap)0 f! m" v/ Y$ l) Q" d0 `  [. L

. s. }: g% E4 r( u* k- FPGA的调试-LogicLock0 c* T- {; T& K+ B

" C# z* |6 h6 M- k- FPGA的调试-调试设计的指导原则6 O9 E6 {6 w( n# q

6 G: f% ^7 A8 e9 |$ B上述内容主要参考《通信IC设计》,有兴趣的可以自己购买书籍进行研读。! x) l# Q! \4 h5 u" n" U' y
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调试设计的指导原则
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