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FPGA 之 Select IO 篇(2)_IO 逻辑资源简介-------xilinx7系列

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发表于 2019-5-20 11:38 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 pulbieup 于 2019-5-20 13:08 编辑 / c3 ?1 D! q8 F6 Y) I
% d8 G7 [/ m8 o: B3 c" y6 ]6 k
FPGA 之 Select IO 篇(2)_IO 逻辑资源简介xilinx7系列
0 m$ E8 M8 S; W! g8 y
目录
8 D' i" n$ ^0 O/ \1 x+ j' J) ?% ?) z( B' l6 N
1, ILOGIC  y, Q/ n$ ?! d8 R6 j3 P

/ E$ Q+ l# O8 L) b. r2, IDELAY
1 ]% y- b# S% \! X9 o
4 Q5 J5 z6 f. v( x( d1 [6 h7 m: Z
3, IDELAYCTRL1 X! a% M- R2 f5 h3 N

% b! H4 X2 q4 E2 s' I5 n4, ODELAY  G. L0 I0 C' W8 ^: Q
8 `- o' _" N! z. g' @3 U
5, OLOGIC; U, u/ x. v* J. S5 J9 e, ~& f
1 n! H$ X) i3 S4 p" ^$ w1 x

& _  u; y  _7 ^. m) y) R2 Y7 n+ Y- I  R# E; \) R( _6 H

4 a" I; L- U. T% P! x& @       上篇咱们简单的说了I/O的电气特性,本篇咱们接着介绍I/O逻辑资源,先贴上两张图。图1为HPBANK的I/O模块,图2为HRBANK的I/O模块,两者区别在于后者无ODELAYE模块。                           6 v% W) y# ?4 s$ Z. C
' W1 C# u9 z* d. A$ D, {% U5 n
9 ?. ?1 i( X/ Z

/ i' `3 r+ A9 G
图1:HP BANK I/O模块

& a. y, W9 r, i2 N2 J$ `$ @4 W7 b( I( S. Z. ^( j) n7 C  ?7 L/ t

5 |" W7 q7 l) }9 ~. Z
8 G5 T# t/ a# L( K
图2:HR BANK I/O模块

+ d! O0 _2 X( N' L# X* M" J
% C) b- X# t% \+ s0 s( B- A
6 w3 z; y! a) E* A8 i. ?, G$ B0 {5 m  d9 V0 \+ U3 `
I/O逻辑资源主要包含5部分:& J  a2 |7 |9 E" b4 y. K$ F% t# O  k& y

8 t5 g/ \& ~! f( I1, ILOGIC2 E9 S, q* T1 m5 a( L
/ q0 v) T) E* w3 @8 ~2 ?
ILOGIC即输入信号处理逻辑,紧挨着IOB,外界的输入信号最先经过的就是ILOGIC。ILOGIC是由许多的数据选择器和一个IDDR(input
% b" h3 N7 E3 P4 ^# K' |& \1 _6 |1 i$ a0 R8 b2 y4 N- f
Double data rate)触发器构成。该触发器既可以双沿捕获输入数据也可以拆分成普通单沿触发器。在HP BANK中,ILOGIC被称为ILOGICE2,在HR BANK中,ILOGIC被称为ILOGICE3。图3给出了ILOGICE3的示意图:
! n: G. x' {! d. ^; q+ [5 v: X0 y, l: x6 ?  V/ ?: U

# v/ S3 A& K" ^! H/ e" O) Y
2 h9 a) r" e: x+ [5 a
图3:ILOGICE3示意图
& v1 M3 B  R% C& R; n/ [

! b/ m) C+ N1 J* h4 G
; x+ A7 P" b) u' Y) O
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( c$ w% }) V- {% ?# j$ r% m1 m9 C" m

% {# _2 w7 w* G( U2 r为了方便咱们使用I/O逻辑资源,xilinx公司专门将本篇介绍的几种模块集中起来,构成了功能强大的源语ISERDESE2和OSERDESE2,咱们只需要调用源语,正确使用源语就能够完成高级的I/O逻辑设计了,下篇咱们就聊聊高级逻辑资源ISERDESE2和OSERDESE2吧!
8 a7 i6 E% d2 _9 |2 r
! h2 w% G' f- L# s9 S! @% P
# Y# o! m: s) h0 x
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