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本帖最后由 uperrua 于 2019-5-17 16:14 编辑
" N: }4 v; F* a$ v* {- f; m$ q+ @3 X" H2 o/ j
此篇只有目录的第二部分,其他部分请查看上、下篇
+ g2 L9 J5 Q& y背景:编写好IPcore并且验证通过,但是接口需要进行HLS。 [+ d1 I, I( S# @4 {/ n
# {2 A' S; w* k+ B
目的:将卷积IPcore接口进行HLS,将权重输入输出同步为DRAM的地址,axi-stream协议进行传输数据。将神经网络参数通过axi-lite协议进行传输。+ @% X+ {9 ^2 b3 B
/ D7 {& Q) m' u" i- H( ?目录
' C: M) V* l; _% n1 t8 x/ x4 q% ^1 ~5 x
一、参考部分的接口3 V6 {& B% M( n
( m+ b4 D& S, v! i; [ 1.1 axi-lite
2 y: n+ k5 P& A; l- N
* f+ H7 D; I7 b3 ]1 A3 Q 1.2 m_axi
0 M. B& x4 @" |- E) q
2 A' \5 v7 c6 w' V' [& u二、添加指令
/ B' J$ {/ h$ M; Q1 ?$ \" a/ V, P$ m% ?# M- U
w' \: J' z: s9 Q! ^) g. |/ }" e 2.1 需要传递的参数(参考)
, W, U# n( l( @4 s, E; K& o' s# F$ f# O; N" R/ `/ |
4 P5 x& _3 ~0 x3 Z! n; f
2.2 IPcore的参数传入(参考)
% S( w' v$ G% r
+ q% `6 |# M) c V" `7 N) u- @5 G6 V/ g" v
2.3 加入volatile指令
( ?0 \% w+ ~7 M1 w1 [! {. O" |+ T/ G9 o* u. s4 x; C4 J0 {
( w# A8 f- |/ K5 I6 L* k4 m 2.4 传入参数更改
& ?$ J$ r% r; ~/ g: z2 T# l6 V- n
' [" F/ [4 T; q9 v, N, g
[% b- Z% _5 j$ Z4 ` 2.5 最终执行的接口HLS
% t4 N9 @+ r" L, i1 b1 X) O. E& Q, T& E5 O& O. r2 r
三、进行HLS
3 v. a3 e* \2 h' S; O5 F& f5 n. C! I4 w* s6 J% N
四、 必须有return值( A x+ J7 p$ E# S6 d2 W/ c
5 l$ E$ M1 v# a; H4 l& ]8 w
3 }( w. ^6 d( J2 x
2 K. f; }& _/ g# N+ I. K
. e' E! M, i; \; _
二、添加指令1 d8 Z7 \ L& Y+ }
4 J' L5 C V% d( m2 }: B+ ]# v
2.1 需要传递的参数(参考)
. K* n" A9 c2 }) z( \5 h8 Z/ C8 r- |: X# x4 I u: W
此步因为涉及多指针的问题,后面舍弃掉了。
$ j e. L/ B0 c' F, R, L
! J" m. o8 W$ p( K函数之中,需要用到axi-lite指令传递的参数为:
) t7 B9 J9 Y$ r8 ~/ O) ?* i6 S% P) R5 ~% P( K- a
-----------------------------
* k; ~) |* ]9 U3 x2 i: }8 J4 h* l
# m- h- n# ~& ~8 z# b* ^//current varable for loop/ I/ S+ W5 |$ }1 E4 K% g( E( {
; [ O) B q& r
int cur_channel_out,cur_channel_in,cur_row_out,cur_col_out;
- u( |8 y/ n* k6 y5 ~: q3 k& l1 L
$ i. [- t/ H2 w$ B9 k# }int filter_col,filter_row;
1 z8 e) ^/ Z( h2 E& b; X5 B( X, y+ Y1 \9 j2 S; W
$ `! G4 f0 x7 A) a2 R2 D
, Z9 i. i5 M' h! G. W) S$ a7 D/ }6 _; K
# V" }1 Z) q t6 H& d# c
4 F4 ?; U5 V6 k7 M4 a# x# a' b+ _ ?( p6 N
) [" w& X* ~6 v5 y0 v# g7 V, s
# U! ]' c! T' o) \! a4 y
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