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modelsim下编译xilinx库的方法

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发表于 2019-5-10 09:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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modelsim下编译xilinx库的方法

5 ?* ?3 W# [' n
' I* V) m1 s6 q8 V$ e3 ?7 \* T 建立ModelSim SE 的Xilinx仿真库方法,从网上搜到的有很多,实践过其中几种,其中一种较简单的方法如下:
# i  e+ m* r/ f1)当然是要安装ModelSim 和ISE 。0 G& i9 ^" i  S* a- u; }1 ?/ J9 U
2)将ModelSim根目录下的modelsim.ini文件的只读属性去掉。
2 l4 y& d( B0 P; Y; {3)在ModelSim命令窗口输入:compxlib -s mti_se -arch all -l vhdl -w -lib all  W- B6 a4 d) m8 \* q/ w7 s, ~. w
按回车键即可。* u& ^9 X- [5 |' b6 W- t
说明:上述命令行中的vhdl 表示vhdl语言,如将此处改为verilog,则生成verilog的库。( g8 @4 [" y) V6 }1 m4 s; s5 x: y
4)将ModelSim根目录下的modelsim.ini文件设为只读。% E3 _( y3 P  @/ F7 Z, B- R
完成上述步骤,重新启动modelsim,即可在libarary栏中看到已生成的Xilinx库
6 K* R  m( ?' i7 _. I& D
0 \& e' x* P0 @3 g: j6 l

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发表于 2019-5-14 18:02 | 只看该作者
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