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请教SDRAM等长布线?

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1#
发表于 2009-4-28 22:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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现在布线布到SDRAM了0 Y# D8 @- `9 l1 ?) d0 v8 p
想请教下:! h! K2 V' Y1 H/ `% ?9 F
1:数据线、地址线、控制线 哪一组对等长要求比较严格呀?
* L+ S; Z+ L! M! }: l2:数据线、地址线、控制线、时钟线 布线的长短关系式怎么样的呀?7 M3 m5 P" h- \0 ]: A6 [
3:DSP到两个SDRAM的数据线 地址线 控制线是在各个SDRAM处等长呀还是两个SDRAM处都要求等长呀?
5 _# a- \* J: m6 k4 Q! F    比如D0、D1到SDRAM1,D2、D3到SDRAM2,这样的话是D0、D1相等呀还是要求D0、D1、D2、D3都必须要相等呀?; n+ k; L, }% i0 |, ?
    那么地址线 时钟线 控制线也和数据线的要求一样吗?; I1 o. x) x/ I
4:在走线中间加的匹配电阻应该记入等长线里面吗?该如何计算?: _4 G2 Y. U  X5 a# W$ z+ v% S, u
5:等长线是引脚到引脚间的长度吗?

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2#
 楼主| 发表于 2009-4-28 22:47 | 只看该作者
关于这点有太多的疑问了0 b) ^. l- a$ N2 Q
希望大家多多指点
$ [$ `; @. K# ^6 I谢谢# ]9 b; p; L( w4 k' `: v
讲的越详细越好
, f2 \* g# J& P- t/ u- Z! @谢谢

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3#
发表于 2009-4-29 09:14 | 只看该作者
有太多的疑问,感觉你没有理解芯片的工作方式,建议你还是先学习一下芯片的时序图,要不等你调试的时候也很郁闷。

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4#
 楼主| 发表于 2009-4-29 09:39 | 只看该作者
有太多的疑问,感觉你没有理解芯片的工作方式,建议你还是先学习一下芯片的时序图,要不等你调试的时候也很郁闷。: Y$ ?, w- U6 H5 x! ~
liqiangln 发表于 2009-4-29 09:14
$ I' o0 O% b2 k0 x2 U2 ]
谢谢
1 p, [% k2 r# O$ v! N& s# i. _能不能说的详细点呢
头像被屏蔽

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5#
发表于 2009-4-29 14:52 | 只看该作者
提示: 作者被禁止或删除 内容自动屏蔽

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6#
 楼主| 发表于 2009-4-29 15:10 | 只看该作者
SDRAM不需要考虑等长问题,除非你的走线特别长(>4000mil)。别把问题复杂化。而且千万不要认为涉及到高速数字信号就是等长问题!
% T# H* x9 F' [3 ^_hhh_ 发表于 2009-4-29 14:52
# W+ y8 {& e* a  c% P. ~
所有的走线都不考虑等长吗?
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