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VHDL结构体
V0 ~- t& f7 C& k
6 {' g% ~2 b) w用来描述设计的内部结构和逻辑功能。3 R) m' n( Y3 _6 m
' A r; O, A. ]! _: I基本结构
6 K: E* c3 F, Q) l) y' R
* M& r. g0 I& v- ~7 Q% J1 ~ARCHITECTURE<J结构体名>OF<实体名> IS4 u9 ?9 X) t I9 R4 }
: H0 g" ]2 q4 a2 l" P/ @
[结构体说明部分]1 K/ w. {0 V7 n7 l( ~9 m
1 d1 Q. D1 [- y) Z7 Z
BEGIN) F: f* [: V7 A; ~7 L7 L
7 L( e g% }4 t+ T<并行处理语句>
8 R9 l: \ q9 p9 }4 B, w+ u
/ A, ~- [5 e! U0 l% s4 DEND [ARCHTECTURE<结构体名>];1 R1 v$ E* U2 |
# d8 C, Q! V- n8 u* q
% ~. C8 R4 @3 t) J" w# ?0 U其中ARCHITECTURE、BEGIN、END 等称为保留字
; Q" @. R) o) s* S0 C, T' `7 H7 E) y7 [% {' A. Y, E$ q
结构体说明部分：用于对结构体需要使用的信号、常数、数据类型和函数进行定义和说明。
2 \6 p/ A2 R, s5 Z3 L$ s3 n# ]$ `# B5 Y, Z
功能描述语句： 描述了结构体的主要功能。 V K, t' F$ D# g) U" A$ k4 X
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发表于 2019-3-14 09:53
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