本站微信 收藏本站 设为首页
 找回密码
 注册
关于网站域名变更的通知
EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › xilinx 能power gating BRAM吗
返回列表 发新帖
查看: 414|回复: 1
打印 上一主题 下一主题

xilinx 能power gating BRAM吗

[复制链接]
abcde1234

该用户从未签到
跳转到指定楼层
1#
发表于 2019-1-24 14:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录！

您需要 登录 才可以下载或查看，没有帐号？注册

x
( U& p! S, n5 a0 ~3 t
# U7 |; i% P- |4 M
7系列的FPGA想要在下载bitstream时，power gating住FPGA的BRAM，然后读出未初始化的BRAM值。希望各位大神能给点意见。& z; t- Z0 z( f+ m
$ ]. D5 b5 a% S6 C# m* O% G, G2 o
给点文档也行。

下载资料威望不够？点击查看获取威望的N种方法>>
回复

举报

EDA365微信号及QQ群号！
返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

GMT+8, 2025-7-27 11:37 , Processed in 0.109375 second(s), 23 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表