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FPGA与DSP

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  • TA的每日心情
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    [LV.1]初来乍到

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    发表于 2018-11-28 10:42 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    x
    FPGADSP& ^: |6 i' B6 ]- O& M) f
    4 l5 X* \; ^5 g0 p4 `5 Q: L3 j
    FPGA的结构特点:. Q9 |% ], T4 A  ?5 z: {) z/ L/ T

    , }' }" a4 s' w片内有大量的逻辑门和触发器,多为查找表结构,实现工艺多为SRAM。规模大,集成度高,处理速度快,执行效率高。能完成复杂的时序逻辑设计,且编程灵 活,方便,简单,可多次重复编程。许多FPAG可无限重复编程。利用重新配置可减少硬件的开销。缺点是:掉电后一般会丢失原有逻辑配置;时序难规划;不能 处理多事件;不适合条件操作。
    5 H( Z' J  a5 w& D, K
    ; [3 C4 @+ B% m! {6 k- C* D' r9 [
    / A7 J, e: p. s. X0 i$ \) a+ P$ r3 D. B2 L8 R+ `
    DSP的结构特点
    ! S" ~9 i$ ~, ^' p- s) k  n' p! m8 b* l* n8 g
    1、 采用数据和程序分离的哈佛结构和改进的哈佛结构,执行指令速度更快。0 \6 n1 p% ~9 J4 Q& q
    1 K5 H8 O; ?) Y& f9 \( B$ N, A
    2、 采用流水线技术,减少每条指令执行时间。8 _2 q  a7 V$ `7 A7 J2 H

    0 V# {$ Q4 ?; f6 w9 M. u2 e9 j$ s3、 片内多总线,可同时进行取指及多个数据存取操作。, ?1 D+ ~$ H  q& b4 r; r

    , ]* n& f- N+ R3 [2 g% H  K1 Y4、 独立的累加器及加法器,一个周期内可同时完成相乘及累加运算。
    1 p* y0 e' v4 C2 W# P' V
    & y: z2 T$ @( H- G5、 有DMA通道控制器及串行通信口等,便于数据传送。
    9 a0 i2 J3 S# e& Q  D
    3 n# l& |" V! P8 [4 [6、 有中断处理器及定时控制器,便于构成小规模系统。0 F% F" }4 f  h

    - q8 a3 U; k2 E. a/ U; S7、 具有软硬件等待功能,能与各种存储器接口。
    + }2 L9 S& I" U6 J( |9 m: o& R3 c% z1 E/ z( `4 i

    7 _5 H& E! G, d& g" k
    0 R7 L( k$ g" ~' w/ D9 TDSP作为专门的微处理器,主要用于计算,优势是软件的灵活性。适用于条件进程,特别是复杂的多算法任务。DSP通过汇编或高级语言(如C语言)进行编 程,实时实现方案。因此,采用DSP器件的优势在于:软件更新速度快,极大地提高了系统的可靠性、通用性、可更换性和灵活性。缺点:受到串行指令流的限 制;超过几MHZ的取样率,一个DSP 仅能完成对数据非常简单的运算;研发周期长。
    4 u/ t% Y" {6 }5 W# c, D
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