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楼主: Apple0988
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晒作品(1对2DDR,并列)

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该用户从未签到

31#
 楼主| 发表于 2018-10-20 00:51 | 只看该作者
leleeda 发表于 2018-10-19 16:30$ |" E, E7 J8 z+ n
我觉得那个回复说的没有问题啊,本人画了N多年板,接触的也有上千块单板,各种ddr都见过,各种变态要求也遇 ...
) F6 j0 X% J2 ~  o8 r6 [
n年是幾年,年份不代表能力,目前就兩種,一種fly by,一種t點,您創造新的做法了嗎,所有誤差10mil  ,clk通通包地20mils,然後差動也要誤差5mils  ,要做多久
! H4 q+ k. c& M: r# v; ?5 \; k
$ Y6 C: j: d( g# j3 R9 k

该用户从未签到

32#
 楼主| 发表于 2018-10-20 01:38 来自手机 | 只看该作者
目前合作過7個ddr一個板子,你所謂的變態也就還好,做的數量多,很多都是簡單的,論壇的出發點美意在於幫助網友解惑,我個人也受到很多網友的幫忙,永遠都有進步空間,未來世界還會把DDR包覆於封裝中。

该用户从未签到

33#
 楼主| 发表于 2018-10-20 08:59 | 只看该作者
leleeda 发表于 2018-10-19 16:304 [" w4 a# l6 l+ ?" ~/ t; o  m
我觉得那个回复说的没有问题啊,本人画了N多年板,接触的也有上千块单板,各种ddr都见过,各种变态要求也遇 ...

7 J/ L% q1 `# \7 D' ?% o跟您們討論完,我也有個體悟,部門這個版本不是allegro最高階,您們大家使用上還是比較喜歡T點那種設定比較快,我用PIN PAIR設定約花二十分鐘,跟最高階那個版本差也沒有很多時間,如果可以選擇,用您們的做法做也不錯.5 Z3 ^* N, a& }; J& X. `

该用户从未签到

34#
 楼主| 发表于 2018-10-20 09:07 | 只看该作者
leleeda 发表于 2018-10-19 16:30
/ w5 a$ i" x7 C' u& h% ]我觉得那个回复说的没有问题啊,本人画了N多年板,接触的也有上千块单板,各种ddr都见过,各种变态要求也遇 ...

- l. B& {3 M5 \4 R- y+ O你放一個你曾經做過,類似這種T點的檔案上來,觀摩一下,我也想看看你的做法.
- u9 n5 {: P$ o1 n. ~2 ]* j

该用户从未签到

35#
 楼主| 发表于 2018-10-20 18:05 来自手机 | 只看该作者
Colbie 发表于 2018-10-19 15:271 J/ {& a* ^$ t, t2 n
总体很不错,因为布线层数相对较少,有一定难度。0 y9 @6 J. B! p# I) V; l
建议:1,中间T点的孔可以稍微排列整齐一点(个人有的强 ...
) k0 K8 j1 z; L+ H2 Q
抱歉啊,近日情緒比較積動,中間T不對稱是故意的,主因是因等長限制還有包地的要求,真實檔案其實穿越也行,換成十層板就多兩層地,有個可以改近就是繞線gap。
  • TA的每日心情
    开心
    2023-6-5 15:38
  • 签到天数: 51 天

    [LV.5]常住居民I

    36#
    发表于 2018-10-22 11:52 | 只看该作者
    楼主 太牛beer了,第一次见这么漂亮的板子,以我有限的想象力实在想不出还有谁能走出这么漂亮的板子,太帅了!
  • TA的每日心情
    开心
    2021-12-31 15:49
  • 签到天数: 66 天

    [LV.6]常住居民II

    37#
    发表于 2018-10-22 17:59 | 只看该作者
    我研究了下这个板子,楼主所说不用T来实现等长是U55~U2,U55~U1一起做等长是吧,这样就可以实现"T"的分段都是等长的。抛开T型拓布结构,看了下CPU的DDR部分管脚分布,是不是Fly-by更合适呢,地址线2层全部从左边走,右边同时走32位的数据线,2个内层走线应该可以走完,个人的一点看法

    DDR.png (55.61 KB, 下载次数: 2)

    DDR.png

    点评

    我看過飛線 確實非常適合FLY BY  详情 回复 发表于 2018-10-25 17:34

    该用户从未签到

    38#
    发表于 2018-10-23 09:23 | 只看该作者
    5个声望。。。。。。!你这个板还没优化吧?

    点评

    還沒阿 玩玩 練習  详情 回复 发表于 2018-10-23 12:15

    该用户从未签到

    39#
     楼主| 发表于 2018-10-23 12:15 | 只看该作者
    空空换 发表于 2018-10-23 09:23: a& L" j+ ~* G$ Q" `
    5个声望。。。。。。!你这个板还没优化吧?
    ; p$ u" A* H7 e. ?; V% a
    還沒阿   玩玩  練習
    6 f7 ~8 B) q; j" @! L

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    40#
    发表于 2018-10-23 14:30 | 只看该作者
    基本算及格了,问题不少。$ V2 M6 B7 m' V/ E
    1,这个引脚分布应该用菊花,虽然2个菊花,T型都可以。当然你可能只是试试你的等长策略。  c: `, b2 W6 G8 ~3 v
    2,用MATCH GROUP也不复杂,可以尝试我发的skill,只需要5秒设置完。
    ' J# R# U+ a4 q) z0 U. K0 O2 }3,等长是时序手段,而不是目的,不绕等长才是最好的,所以画完先优化走线走向看还能缩短不,而不少直接找出最长的直接把其他线长网上靠,同样的,DQ+DQS要求的是组内等长,而不是所有bit等长,0-7即可,而且合理利用组内的DQ互换原则,可以大幅度降低走线长度和绕线复杂程度。我没试,但这么弄出来的绝对比现在好。: y* _( Y- y# n! F9 p$ d, d, X
    4,同上,有了同组同层,你的DQ就简化了,DQS也不用在表面走那么远,这个在高频时候还要考虑表层内层传输速度+过孔长度问题,没必要复杂化5 I2 S7 D8 ?" W
    5,相对于时序同样重要的还有阻抗,串扰之类的,临层处理原则是十字交叉,,同向的话错开走亦可。
    + j9 [# i' X) S6,同样的,绕线也是串扰,间距X3以上,时钟有空间继续拉大。你等长做好了,时序好点,但是绕线自己反复耦合信号会很差,眼图将来一塔糊涂,可能还不如不做。

    点评

    這位前輩 高見 你的理論與我們實際面比較相似 當然這板子 我做的很不足 主要原因是Allegro 不夠熟練  详情 回复 发表于 2018-10-25 17:36

    该用户从未签到

    41#
     楼主| 发表于 2018-10-25 17:34 | 只看该作者
    heyan504538 发表于 2018-10-22 17:59
    " |; K" m! x! E; G  m, \9 u" H我研究了下这个板子,楼主所说不用T来实现等长是U55~U2,U55~U1一起做等长是吧,这样就可以实现"T"的分段都 ...

    # i4 o" N; ~5 {1 @, y, X5 W我看過飛線   確實非常適合FLY  BY     
    1 x2 F) o0 j* t7 E# i: G' M' _+ i

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    42#
     楼主| 发表于 2018-10-25 17:36 | 只看该作者
    kevin890505 发表于 2018-10-23 14:30- o# _; I! `* A
    基本算及格了,问题不少。
    1 A' j" q& I# y7 W) s1,这个引脚分布应该用菊花,虽然2个菊花,T型都可以。当然你可能只是试试你的 ...
    3 d/ p( Q) t1 C' v
    這位前輩  高見   你的理論與我們實際面比較相似   當然這板子  我做的很不足  主要原因是Allegro  不夠熟練
    2 g! j. n0 Z+ \5 I0 q! t5 R- V; Z

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    43#
    发表于 2018-12-25 18:36 | 只看该作者
    楼主还是比较牛逼的
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