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[Cadence Sigrity] Sigrity DDR仿真时眼图查看

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1#
发表于 2018-8-7 18:30 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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Sigrity DDR仿真时眼图查看时可以一个位宽(产品CPU为16位)一块查看吗?时序和抖动余量;- L" W6 ]- B5 o! i5 l
之前看一老师仿真视频,多组数据一块打开时,眼图很差,他是单独每根数据独立查看;3 p3 C6 L1 d1 c& W
此处有疑问;请高手帮忙解答;
) {" F0 g! H5 T& C! F+ S多谢;
1 q: G+ ~: g5 z/ E

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2#
发表于 2019-2-25 09:52 | 只看该作者
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点评

一块看时,芯片器件的封装长度该如何提取到PCB对应的S参数中;  详情 回复 发表于 2019-4-11 11:42

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3#
 楼主| 发表于 2019-4-11 11:42 | 只看该作者
Lee_G10D0 发表于 2019-2-25 09:52( w7 t- |; d: ]+ O
需要一起看
7 j9 D- [1 I" M' ^8 L
一块看时,芯片器件的封装长度该如何提取到PCB对应的S参数中;

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5#
发表于 2023-4-4 11:00 | 只看该作者
需要一起看
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