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一个关于part的管脚定义的问题

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1#
发表于 2009-2-8 12:08 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我在画ATMEGA32的part时,定义好了管脚,保存时出现 Warning: Duplicate pin name on Gate A - Logical pin 5 - Pin name VCC
8 O/ k3 [  P5 O4 M! E2 r9 l( j
& |7 d" `* u7 i+ w2 R2 d
* S  ^" i8 C2 D2 `8 V; }9 h+ L% i; S  o其意思就是我的定义的管脚名有重复了.以VCC为例.5 F) A2 N1 D+ J3 h0 Z

* u# |' J' F2 Z0 A1 F  N1 R4 e0 Q) q+ j- H% v( d
解决方法:, y8 W! O) ]# A( x) i
6 O, \1 B8 T- E& s
1  将原为VCC的管脚分别定义成VCC0,VCC1,VCC2,以让其不再重复.
& W* e: L4 w$ d# c- G9 _
6 A1 {' e6 w/ p' V% n% H5 H
# q9 |7 ^! W$ {, z. j请问各位同仁是否还有其它方法?- H. t) u" P! C3 _2 ^5 g6 O  l

4 e7 P$ D  O3 `' Q, H$ x) C- s5 s7 I  N1 g, P2 X

未命名.jpg (82.02 KB, 下载次数: 2)

未命名.jpg

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2#
 楼主| 发表于 2009-2-8 13:01 | 只看该作者
解法二?

该用户从未签到

3#
发表于 2009-2-9 08:54 | 只看该作者
LZ的方法是正确的。& S3 t. ^  e' K  b  j7 e) g2 P

" Z; A8 V1 @" l  B/ J) P还有一个方法就是添加PIN时不添加描述,然后用添加TEXT的形式也可以实现。

该用户从未签到

4#
 楼主| 发表于 2009-2-9 11:59 | 只看该作者
謝謝jimmy& t9 f2 F- ]6 l1 W! ^3 V6 p
$ I4 |( \* L. L' g! C3 C" \
你的方法可行,作業時需要小心.
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