pcie问题咨询

bluskly

超級狗 发表于 2018-4-20 14:08
7 C, a; ?5 W6 o3 \. T- O6 a布拉斯基發現自己惡搞已經躲起來了！
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这两天都在调试，目前结果看来应该是自己之前认识不够充足。
测试了很多COM-E卡，发现有些卡确实通过SI5344以后不能识别PCIE设备，我们项目是一个COM-E卡挂了6个PCIE设备。采用SI5344的目的是因为很多PCIE的从设备还有系统时钟和接口时钟，这些时钟的频率是不相同的。而且很多时钟对于相位抖动有特定的一些要求，采用SI5344是因为其 Ultra-low jitter of 90 fs rms这个要求。而且根据PCIE从设备的时钟要求如下：

所以觉得很多晶振和buffer麻烦，而且频率都不一样。于是就用了这个芯片。
为了时钟树的简单，于是就采用了PCIE时钟进入IN0通道，输出一路100M的pcie，在采用SI53301的时钟buffer出多路时钟给6路的PCIE从设备提供PCIE refclk。

关于耦合方式都是按照芯片的匹配方式做的，应该没啥问题。目前看来引起这个问题还是时钟不是同源处理，估计COM-E卡内部也能够配置或者其他的，正在考虑跟COM-E卡的技术支持进行探讨。
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出现了这个问题，特地查了一些相关的资料，根据PCIE规范看来，不同源也是可以的，但是对于时钟要求更高。

一般而言，为了减少麻烦，最好是采用同源时钟来设计。
0 {; U4 X+ x- h2 B一般大家推荐也是采用同源时钟来使用。

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最后，将自己找到的几个相关的资料发出来，大家以后设计的时候也注意一下。
  o" X+ e. I9 z! [8 P+ U" | AN562.pdf (11.37 MB, 下载次数: 1)

2018-4-20 22:37 上传

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超級狗

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xiaowenwu1989

学习了

tanchengfang

会不会驱动能力的问题？

吉。。。。。

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吉。。。。。

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ABCDJ

虽然楼主做了很多验证了，但是从理论分析来看，这个问题可能根本原因还真不是时钟同频同相导致，本身高速接口就有机制搞定两端不同频的问题，多半还是时钟质量导致，抖动的可能性较大。

bluskly

ABCDJ 发表于 2018-5-22 20:48
虽然楼主做了很多验证了，但是从理论分析来看，这个问题可能根本原因还真不是时钟同频同相导致，本身高速接 ...

你说的 我也怀疑过。并且单独在pcie device端直接给过一个100M的晶振SI9121+SI53306的buffer输出作为refclk。不再使用cpu同步下来的refclk，但是实际情况就是不能够link起来。难道跟pcie device有关系？

gww8604

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