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[HyperLynx] DDR仿真网络选择

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1#
发表于 2018-1-11 17:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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使用DDR仿真的时候,选择数据网络的时候为何DQ/DM分一起,见图中箭头处。是哪里出错了,如何改正?求教
, w" v! T7 c/ S7 j1 m% |3 _* X& C

2018-01-11_17-24-33.jpg (189.53 KB, 下载次数: 3)

2018-01-11_17-24-33.jpg

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2#
发表于 2018-1-13 10:32 | 只看该作者
前面网络那一步没有问题吗?% \' f: `. _8 N0 r  d

, i1 W0 F4 }! F( b1 K! u

点评

没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。  详情 回复 发表于 2018-1-15 10:26

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3#
发表于 2018-1-13 14:58 | 只看该作者
参考差分的形式,你的模型是不是有问题?定义了差分?

点评

有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?  详情 回复 发表于 2018-1-15 10:29

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4#
 楼主| 发表于 2018-1-15 10:26 | 只看该作者
superlish 发表于 2018-1-13 10:32
+ }1 C7 j1 |) b# v前面网络那一步没有问题吗?

8 C" T- W+ K" d没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。; a: L0 H4 d3 W$ v% B# I

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5#
 楼主| 发表于 2018-1-15 10:29 | 只看该作者
GHOST 发表于 2018-1-13 14:58, f" S# @, i  I1 F
参考差分的形式,你的模型是不是有问题?定义了差分?

6 f0 v8 i6 e6 i. D" g- F" y+ C- u有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?- z& a: l& U! S- {) o+ p1 N

点评

直接打开就可以看啊  详情 回复 发表于 2018-1-15 11:53

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6#
发表于 2018-1-15 11:53 | 只看该作者
dhgchina 发表于 2018-1-15 10:29
; N* I* c' C  O+ S& z有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变 ...

6 B3 g& A) X- U  \直接打开就可以看啊( d. x0 s) c# I# D1 U

点评

问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了  详情 回复 发表于 2018-1-15 20:27
打开看没问题啊,有什么解决办法没有?  详情 回复 发表于 2018-1-15 17:13

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 楼主| 发表于 2018-1-15 17:13 | 只看该作者
GHOST 发表于 2018-1-15 11:53* Q  e& t+ @2 n' l& ]
直接打开就可以看啊

3 P0 J4 V1 Y  G+ @# V, N6 r9 L9 [打开看没问题啊,有什么解决办法没有?
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 楼主| 发表于 2018-1-15 20:27 | 只看该作者
GHOST 发表于 2018-1-15 11:534 k/ j* w8 g9 n4 o4 ]2 S9 E
直接打开就可以看啊

9 }6 a8 H) ?$ A; P' Q8 R问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了3 d& t5 \) n  \/ x. Z9 f/ J, d
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