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[仿真讨论] 电源仿真中DCDC开关频率和噪声频率有什么关系

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1#
发表于 2018-1-7 14:21 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
在做PI仿真的时候有一个是交流阻抗分析,一般我是看到100M以内的阻抗值,实际上也就是20M的5倍频。  我所理解的是因为DCDC的测试纹波噪声的时候就是在AC档位,看20M以内的噪声,仿真多看一些到5倍频,也就是100以内的交流阻抗。
- @. j0 C* j1 r& r- e' Z0 V# i8 ^  O8 C5 l( ^9 J, u

0 j* T7 m* R3 F! X0 l& B+ M( t

8 ~; X/ @' Z. H% n( X但是我最近在看资料的时候,看到有一些DCDC(TI的TPS54331)的开关频率的在400K~700K之间,那这个开关频率和电源纹波噪声的频率20M有什么关系么。5 v: b+ [0 N4 g2 d4 [
我所知道的一个是开关电源的频率大小跟输出电感的大小有关系,然后一个占空比与输出电压的调节有关,但是一直没有弄明白开关频率还跟哪些有关,尤其是在最近仿真PI的时候,总感觉到知识点关联不起来。
6 B6 X5 ]- Q9 k5 v6 B有知道的高工麻烦指导指导,谢谢。& [6 s: L6 J0 r6 i& w7 x# Q, e" z  l

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2#
发表于 2018-1-8 10:19 | 只看该作者
可以参考下这个帖子, ]0 e7 @/ |( W4 U# k" _, Y" A
https://www.eda365.com/forum.php? ... amp;_dsign=d11fbd1f

该用户从未签到

3#
发表于 2018-1-16 14:20 | 只看该作者
简单的说就是与IO口切换速率有关

该用户从未签到

6#
发表于 2018-1-25 21:46 | 只看该作者
Hi
3 K) r4 c8 d1 w% D' d
% l: q. c$ v" K7 q- J! T2 v' h: V, C我個人認為TI所說的頻率是指時域的頻率
+ z, U* O% ^9 m
; _- V$ H1 Y' |. Q1 F- V9 P* n就是切換頻率有點像是Data rate, r4 E( B8 T% v& F: r- @1 j! e
6 y3 P( ?0 [0 W9 e: R7 m& k
它的XY軸的X軸是Time
/ p- Q7 d( i, L4 v$ L& T9 d4 }9 s7 U; a6 S( ^( d9 F# V/ p, [! `
一般PDN所說的是頻域它的XY軸的X軸是Frequency
& N7 Y0 K2 }' F' b( L8 M7 R. c3 U( F3 K  V; v. R! d
因此TI的切換速度要透過FFT轉成頻譜! U/ g0 M; h( s  ^8 p9 S- e% G( y
, ~/ I7 W& @' ^
看能量大多集中在哪邊哪個頻率以後能量很小可以忽略% D. L  ]# h' `
/ r6 e" ?0 K8 n1 K1 W* [" T
其實在頻域看應該是有超過100MHz的雜訊只是能量非常的小可以忽略7 b+ O- ^; N" Y# X# l

6 v3 z) A% q( G# s% a  A如果是正常的IC的話
8 r0 ?2 ]4 A1 I0 ]( e7 X9 F2 {. {) N( B, x7 q
至於PDN為何會選在100MHz3 P' y3 k8 ^) k8 w7 q' I

/ m8 o7 Y: `5 S2 `% g是因為超過這個頻率你電容會因為有ESR ESL也解不掉超過100MHz的雜訊  E9 z# x' d* [" Y3 [

- q, k) {. v7 k: D8 s7 G+ }這有時候因為PKG或是一些IC內部所產生超過100MHz雜訊+ B) ?; G6 r" V

3 W( w4 B7 c- K! E, ^7 w6 `, w可能要透過修改Power Plane或在IC內部用電容處理才能解掉
. ~) Y$ K9 t& S6 s5 ^3 {- ?; k
! z2 h" x6 _3 w3 `9 z以上為小弟個人淺見
$ `! [+ w0 I! `/ E

该用户从未签到

7#
发表于 2018-3-8 15:15 | 只看该作者
1、电源工程师一般用小示波器加20MHZ滤波器确认DC-DC 模块电路输出纹波是否正常,但实际上如果DC -DC 700KHZ开关噪声耦合到输出电路上,实际噪声出现周期是1/700KHZ但噪声信号上升沿很都陡其频谱能量在20MHZ以外* z9 D$ n! L' |( Z
2、电源纹波还要看末端负载芯片手册要求,有些芯片要求500MHZ以内纹波不能超过规范值,所以芯片末端需要bypass电容
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