2017年11月12日QA检查报告节选

EDA365QA

1.top参考第三层没有铺铜
2 F' E  B( t3 v, b5 `$ W7 Z
, O: X# o2 d+ \/ d8 V, y: @8 G& u

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2.差分线跨分割

8 z# n+ k6 h9 C

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3.电源不要走到RF区域
; X/ K/ e' o9 f9 F
. C# S# O$ X+ c! u+ V8 t

EDA365QA

4.电源补强
! @9 i; n( q1 o/ ^$ R
1 \( |# r3 F  g; p  G

EDA365QA

5.共模电感前后分开
: ~% {  D1 _; A2 n

EDA365QA

6.电源输出加宽
0 M7 }! N; y2 U8 c3 l! b7 S, p

EDA365QA

7.匹配电阻应该放置到末端
# }$ J6 a* {# i+ Y3 A
2 R/ n5 O! \) v1 v" t

EDA365QA

8.上下隔离部分不能放一起建议独立分开
0 j: k9 S; R$ n+ B, a6 H0 V
6 `5 @" p- W5 r$ f% R; Y5 a2 E

EDA365QA

9.规则设置不合理，走线部分没有参考平面了
+ X; `. W  z) b) W2 n, t0 X

EDA365QA

10.时钟源端匹配靠近放置
9 V8 K1 U# n" L+ u! g3 }& o% y6 ^

EDA365QA

11.时钟线不要直接在滤波电容中间穿过

剑铮奇迹

EDA365QA 发表于 2017-11-13 09:42
11.时钟线不要直接在滤波电容中间穿过

怎么感觉这个晶振周围没器件呢，难道把电源电路和使能电阻放背面了吗？
晶振处理方法最好是电源和使能都放在同一面，周围包一圈地铜与其他隔离
7 ?+ |2 L  R; y9 ]

dhhtmqh

EDA365QA 发表于 2017-11-13 09:42
# K3 |/ s, @" Y7 C' R11.时钟线不要直接在滤波电容中间穿过

  V4 V; [' G' W; D6 W; T, U. _这个是有源晶振，外围不需要什么器件了吧

648638520

学习了

guhanzuiying