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[LV.4]偶尔看看III
edapcbsyc 发表于 2017-11-1 22:04 7 y; ^# J* K" d# R请问差动信号是指?需要怎么处理?
汤圆LSY 发表于 2017-11-1 16:167 K! s: ^; s, i, g0 \) ? 请教个问题,ECL器件互相连接时、信号线是先到端接电阻再到终端器件好,还是先到终端器件再接端接电阻好? 4 a3 q8 v$ g, y% I: ^$ M ...
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[LV.2]偶尔看看I
EDA365QA 发表于 2017-11-1 08:43& H" _$ u: [8 n 8.光口地处理不当
rock_li29 发表于 2017-11-2 09:12 9 J% p, P, y$ S1 f+ h1 ~应该是错别字,指的是差分信号,差分信号紧耦合布线,控制阻抗。
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