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2017年10月20日QA检查报告节选

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1#
发表于 2017-10-24 11:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 EDA365QA 于 2017-10-24 11:34 编辑 8 b+ R+ R' U% ]( j* J2 |( @5 ^$ l3 Y

  u. _- @: v+ b! O1.电源没加粗
8 l. W, `, b8 U 4 e, z, J' ^% V1 n, O4 n

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2#
 楼主| 发表于 2017-10-24 11:32 | 只看该作者
2.钢网层有多余的线4 N- ~9 c  ]' w  Y$ f

; S* S! b. s; ~# }+ i- t

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3#
 楼主| 发表于 2017-10-24 11:35 | 只看该作者
3.周边螺孔与器件干涉
1 n1 p" f5 o! ]+ Y - o- T7 ]5 P7 J7 ?0 i- }' q: U

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4#
 楼主| 发表于 2017-10-24 11:36 | 只看该作者
4.变压器前后隔离1 Y$ w$ Z) z2 o$ _4 [
2 ]/ L+ R& Z( [1 r- k

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5#
 楼主| 发表于 2017-10-24 11:38 | 只看该作者
5.电源VIA只有1个,另有三个没网络过孔VIA。
# P! v6 @0 o9 g4 _, \. \+ _
+ s2 S4 R" s# g4 w: z3 P

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6#
 楼主| 发表于 2017-10-24 11:44 | 只看该作者
6.DVI线对间等长% C6 k0 d8 @6 X) Q: A( Z
8 m% }% W; A% u3 {( f' _( y. v

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7#
 楼主| 发表于 2017-10-24 11:44 | 只看该作者
7.电源没加粗+ n+ ?% e0 @( o
' x* K$ ^; E7 n! X( \

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8#
 楼主| 发表于 2017-10-24 11:45 | 只看该作者
8.flash拓扑不一致
4 q+ F: W4 u7 l; R 3 w" t4 m$ e4 k( k1 Y1 G5 W

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9#
 楼主| 发表于 2017-10-24 11:45 | 只看该作者
9.变压器中间挖空不过线前后隔离
/ [2 O' ]- j) @- a   g5 m- ]& B/ F

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10#
 楼主| 发表于 2017-10-24 11:46 | 只看该作者
10.共LAYOUT不要出现残端2 j+ j- B; R; P3 ?( s3 T
- S- J3 S! h- x) w5 H

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15#
发表于 2017-10-26 16:49 | 只看该作者
EDA365QA 发表于 2017-10-24 11:45
% ^2 J( K1 |+ g) R4 X2 N/ \9 V- v8.flash拓扑不一致
, j$ Z' g  F6 N" [( L7 W6 }

) o. y$ t) a2 f# o( u
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