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2017年10月20日QA检查报告节选

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发表于 2017-10-24 11:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 EDA365QA 于 2017-10-24 11:34 编辑 ) F2 I; k/ f4 y: l) H9 T
9 X! M: Q& v% U- D( [( }  Z5 K
1.电源没加粗
- e! w" p  D# \: n& u+ _
; S3 c& ^( Y$ b+ W1 r6 \

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2#
 楼主| 发表于 2017-10-24 11:32 | 只看该作者
2.钢网层有多余的线
7 \& L5 S( h5 I+ l
% W3 D( H: \4 v0 {6 W) k& Z

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3#
 楼主| 发表于 2017-10-24 11:35 | 只看该作者
3.周边螺孔与器件干涉4 j! o+ {) x6 B, w# U. y
/ W9 x. ?: N; R* _  d

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4#
 楼主| 发表于 2017-10-24 11:36 | 只看该作者
4.变压器前后隔离
9 @/ W4 ?% L& \+ _+ G( d: N ! f( G1 X) X' y

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5#
 楼主| 发表于 2017-10-24 11:38 | 只看该作者
5.电源VIA只有1个,另有三个没网络过孔VIA。' r1 O  a9 C  U3 g( d: Q8 ?

* j5 \, B4 V. r' ?) C

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6#
 楼主| 发表于 2017-10-24 11:44 | 只看该作者
6.DVI线对间等长. a' K- r# i  ?& S/ U9 r
) N9 R8 s9 g# `. h3 k0 |# d; d4 c

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7#
 楼主| 发表于 2017-10-24 11:44 | 只看该作者
7.电源没加粗
( l. T( C5 }! R , v, a6 Z3 \6 V6 J- |( N  \

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8#
 楼主| 发表于 2017-10-24 11:45 | 只看该作者
8.flash拓扑不一致
1 w' p/ a( _$ X8 M/ \ 5 D5 p* B: n6 D% o0 M

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9#
 楼主| 发表于 2017-10-24 11:45 | 只看该作者
9.变压器中间挖空不过线前后隔离
# e& s" {  N; ]$ d, J . C8 l6 ?0 o0 v' w7 L+ j! P$ ?

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10#
 楼主| 发表于 2017-10-24 11:46 | 只看该作者
10.共LAYOUT不要出现残端& J; u1 o9 a+ C: _1 k- B

% ?8 \: t% v0 e4 B

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15#
发表于 2017-10-26 16:49 | 只看该作者
EDA365QA 发表于 2017-10-24 11:45% @( y% e1 H  H6 X( V: R
8.flash拓扑不一致

2 t$ i1 Q8 f+ h9 d: h0 J5 z( S, }  s2 j# H
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