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allegro 17.2 怎么建立Xnet

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1#
发表于 2017-8-5 15:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
15金币
本帖最后由 tiny丨Y 于 2017-8-12 10:28 编辑
* t: s$ j' b* z# H% \0 S0 u/ O  i( x$ c8 v
问题如题我不是小白
5 W  F" S- a/ P, w用signal model assignment方法试过了,建立失败- J5 J8 c. _9 n* Q3 S4 B& Z% W
请用17.2试过成功的大神帮忙解决. ~7 S3 c# I6 g/ l8 u
版本17.2 S094
" z/ A4 n0 z( d+ P, F+ w  _& ~感谢rock_li29的帮助:可能是你的BRD文件数据有问题,提示电源和地网络有问题,重新开一个新的BRD file,把现在的器件,走线,铜皮贴到新的BRD文件可以设XNET.$ p4 Y( ]8 {' s* _

: j( @1 B! E- I+ Q- \

5 o" u% B. `( n" |9 T$ p已确认解决,但还是没找到为啥 原来的brd不能设置 继续求助0 ^0 d* L7 m  H# m

最佳答案

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附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。

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2#
发表于 2017-8-5 15:34 | 只看该作者
tiny丨Y 发表于 2017-8-7 09:447 W/ A+ W0 x2 k: ]  ^
方便加个QQ2542796636 附件不好上传

# I& m! T1 S/ Q% ~附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。
; C% s2 `% |; S8 v

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附件  详情 回复 发表于 2017-8-8 14:45

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3#
发表于 2017-8-6 17:59 | 只看该作者
没有用过17的版本

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4#
发表于 2017-8-7 09:18 | 只看该作者
17.2的补丁已经到094了吗?

点评

057吧  详情 回复 发表于 2019-8-7 13:14

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5#
发表于 2017-8-7 09:33 | 只看该作者
跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。
6 v8 r. W/ a4 a6 _( G3 m

xnet.png (47.96 KB, 下载次数: 4)

xnet.png

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方便加个QQ2542796636 附件不好上传  详情 回复 发表于 2017-8-7 09:44

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6#
 楼主| 发表于 2017-8-7 09:44 | 只看该作者
rock_li29 发表于 2017-8-7 09:33
7 B. X, @" y, P跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。
7 U; y4 S3 i5 G6 x
方便加个QQ2542796636 附件不好上传

点评

附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。  详情 回复 发表于 2017-8-8 10:14

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7#
 楼主| 发表于 2017-8-8 14:45 | 只看该作者
本帖最后由 tiny丨Y 于 2017-8-8 15:01 编辑 2 J3 l, K0 a0 r8 @& E% r' G  t3 }
rock_li29 发表于 2017-8-8 10:147 S! h: z8 x- }2 N6 d* Y
附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。

( @  x0 e$ A- b% a" q! }' ?6 T私信你了

pcb.zip

1.22 MB, 下载次数: 32, 下载积分: 威望 -5

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8#
发表于 2019-8-7 13:14 | 只看该作者
zuoanwind 发表于 2017-8-7 09:18
6 p* c5 u1 B7 \( V9 U- A17.2的补丁已经到094了吗?
0 R/ @" P; o" ?1 _' `
057吧
2 B8 {* G/ H- I6 @

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9#
发表于 2019-8-8 05:59 | 只看该作者
17.2的问题。

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10#
发表于 2019-8-8 06:07 | 只看该作者
不方便截图,这是新找到的,是17.2的问题
, F- W" s" V' j" d- u3 P. @6 ~- b3 k, p0 o
1.Close the design if it is open in Allegro PCB Editor.
- `1 v) A4 @" O4 j0 ^9 W# b3 ~2.Add the CDS_XNET_STATE_UI variable​ with a value of 1 to the User variables section in the Environment Variables form.9 j. v4 p' N3 Z: g1 ^. `# J$ S
3.Open the design in Allegro PCB Editor.
0 Z( t, O7 A# x) u, d/ x4.Go to File > Import > Logic and, if not already set, set the Import Logic Type to Design Entry HDL.; Y; U( ~3 I( f
5.Open Constraint Manager.
( e# j' O( H( |( J* R2 j6.Select Tools > Options.
3 g% n' G5 G  c9 n0 j  d- v7.Select the Create XNets and Differential Pairs using DML Models (same as SPB 16.6) option.
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    2022-11-28 15:00
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    [LV.1]初来乍到

    11#
    发表于 2019-10-28 11:40 | 只看该作者
    今天我也是遇到了,17.2不能创建XNET。。。
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    12#
    发表于 2019-10-28 11:45 | 只看该作者
    版本17.2 S094  能分享下S094的补丁?

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    13#
    发表于 2019-10-28 19:55 | 只看该作者
    試試.謝謝!
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    14#
    发表于 2020-3-13 11:44 | 只看该作者
    THANK YOU.
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    15#
    发表于 2020-3-17 13:41 | 只看该作者
    谢谢分享
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