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2017年8月4日公益PCB评审报告节选

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1#
发表于 2017-8-5 08:57 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  分割线上绕线.
/ Y- O6 E/ f# z   {9 C9 f( z' |, p# U2 R! v

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发表于 2017-9-6 15:16 | 只看该作者
EDA365QA 发表于 2017-8-5 09:03* _4 w" S( x" I
6.  CPCI的时钟要求等于2500MIL.
' d: e7 ^9 R9 g6 c4 @6 G
关于cpci的布线注意事项(阻抗、线长、等长控制等)能否详细说明一下,谢谢。: E$ {' t8 L8 E" n7 N

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 楼主| 发表于 2017-8-5 09:02 | 只看该作者
5.  AD芯片中心焊盘连接有误.电路图接的是电源.
' ]; z3 N5 u& P1 J( K: i ) c! {9 m. i! z* i) b6 q* N

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 楼主| 发表于 2017-8-5 09:03 | 只看该作者
6.  CPCI的时钟要求等于2500MIL.! Y; z9 e% @+ }, |( x

0 j) v, j9 O/ h2 o

点评

关于cpci的布线注意事项(阻抗、线长、等长控制等)能否详细说明一下,谢谢。  详情 回复 发表于 2017-9-6 15:16

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2#
 楼主| 发表于 2017-8-5 08:58 | 只看该作者
2.  孤立铜.
) s/ {3 r5 V: t; I/ }- K4 ` , L; V  V' a& t  w& n

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3#
 楼主| 发表于 2017-8-5 08:58 | 只看该作者
3.  晶振电源加粗.
2 d/ W) d- M5 \$ Q" Z9 o: h8 |
, |5 f+ `9 W; N) p- V

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4#
 楼主| 发表于 2017-8-5 08:59 | 只看该作者
4.  DDR3时钟匹配应在末端.9 F  M4 A; s0 `: N2 ?

" _, ]% n/ U* f7 M0 b' I! s) q

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7#
 楼主| 发表于 2017-8-5 09:03 | 只看该作者
7.  保护地间距太近.3 Y4 `* |: G; v1 G& [7 Q- q; p8 U
9 A& I+ b; v/ c  U$ B; _

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8#
 楼主| 发表于 2017-8-5 09:04 | 只看该作者
8.  PWR05层+5V有悬空铜皮.
1 T$ h" s( }! ^
) G; a* K. A( I6 a% \6 d4 A

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9#
 楼主| 发表于 2017-8-5 09:05 | 只看该作者
9.  数字铺铜跨模拟区.
% E# Q# A; c9 |- o, ]% U. _
2 q/ }% e9 w. ^  n( R2 V) ^. g

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10#
 楼主| 发表于 2017-8-5 09:06 | 只看该作者
10.   有2个VIA没有接上电源.& q$ r$ b4 X' ~3 j( B

9 X1 B; l) J* t

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14#
发表于 2017-8-18 13:46 | 只看该作者
过来看看,学习学习!

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15#
发表于 2017-8-18 14:28 | 只看该作者
过来看看,学习学习!
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