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allegro 16.6 如何设定不同Net 短路时又不会出现DRC

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1#
发表于 2017-5-4 12:26 来自手机 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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请问大虾allegro 16.6 如何设定不同Net 短路时又不会出现DRC?

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3#
发表于 2017-5-4 13:37 | 只看该作者
短路肯定有DRC的,没有DRC才是有问题的。, c- U6 s. t" D! ]2 }2 i
建议最好留着DRC,你可以不用理会它,防止后面忘记了,有个DRC可以知道的
' q( C5 X5 W+ ~# ~' d8 ?
6 F% W: k8 N0 t% u" R不同网络如果需要短接,你如果不想出现DRC,可以另起一层(非走线层)画个线短接,9 j4 x& y. a: X* C* ?
但是你设置光绘时候记得把这个线设进去,否则走线层没有这个线生产出来是开路的

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4#
发表于 2017-5-4 13:50 | 只看该作者
短接点建议可以建个封装,(记住不要开窗,这个不需要焊接的),前后网络可以不一样,中间画个线(非走线层)端接即可,光绘设置时记得把那个非走线层的线设置加进去,否则就不链接了。
+ G5 w' K' ]- R3 z- E) m2 }

点评

请教在哪层画线,出gerber时怎样添加这一层?强行连接DRC没办法出gerber  详情 回复 发表于 2017-5-4 13:58

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5#
 楼主| 发表于 2017-5-4 13:58 | 只看该作者
superlish 发表于 2017-5-4 13:50
4 u3 j; m3 F8 F, Y4 e短接点建议可以建个封装,(记住不要开窗,这个不需要焊接的),前后网络可以不一样,中间画个线(非走线层 ...
1 U4 i' z# S, I0 E+ S( j/ W2 M+ k
请教在哪层画线,出gerber时怎样添加这一层?强行连接DRC没办法出gerber3 R) K$ f) |- r9 J  c! y
9 ^4 b8 W% M1 w; w- O' h1 F

6 o2 q+ t+ S. _# |+ A
0 f$ B2 j3 j6 w% O. M2 D

QQ图片20170504135729.png (33.4 KB, 下载次数: 10)

QQ图片20170504135729.png

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请问下你这个有在原理图上有标示出来的吗? 最好原理图也标一下,要不下次改版或者换别人做就不清楚这里强连是什么意思了,别人估计会当做短路处理了。  详情 回复 发表于 2017-5-4 15:08

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6#
发表于 2017-5-4 14:57 | 只看该作者
强连也可以出GERBER的6 m1 L1 ^, E3 L3 U! }: v; S
最好自己定义单独一层,防止和其他信息冲突
# |# R1 A# U. ^( @ 6 @7 X, v/ O3 X
! B. Z+ S& X2 k: R+ o' j7 ~/ o" t

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7#
发表于 2017-5-4 15:08 | 只看该作者
finezhang 发表于 2017-5-4 13:58
' j1 y! b* t* b2 `2 w4 c) m请教在哪层画线,出gerber时怎样添加这一层?强行连接DRC没办法出gerber

) i$ j. h8 o5 @/ r9 e请问下你这个有在原理图上有标示出来的吗? 最好原理图也标一下,要不下次改版或者换别人做就不清楚这里强连是什么意思了,别人估计会当做短路处理了。) U3 d6 X5 t8 \& g% D

+ Z7 t9 z' n) A( m8 X, F  J

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8#
发表于 2017-5-4 15:22 | 只看该作者
还有一种短接的,铜靠近点,弄最小间距不报错就OK,然后开钢网,一刷锡膏就连上了
0 m# O! }5 b% n# W! s$ l9 u9 x; T/ h+ Z& t: c
( j3 F) t+ S' g" \

0 H9 S5 M1 C1 K

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9#
 楼主| 发表于 2017-5-4 15:39 | 只看该作者
没有明白怎样在封装里面:添加2个中间画个线(非走线层)" p- [+ Y# p3 o& h2 C
333层怎样添加的

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[attachimg]126702[/attachimg]  详情 回复 发表于 2017-5-4 16:14

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10#
发表于 2017-5-4 16:14 | 只看该作者
finezhang 发表于 2017-5-4 15:399 u9 V, J4 q3 \5 b/ c9 s3 `8 i
没有明白怎样在封装里面:添加2个中间画个线(非走线层)
5 n5 `5 l3 M' C' H' k9 Z333层怎样添加的
$ p& Z) a- q' I' A, a1 f8 ^
4 G5 Q; k: e& B: Y& B

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元件如果放到底层,top和bottom层怎样区分?  详情 回复 发表于 2017-5-4 17:35

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11#
发表于 2017-5-4 16:57 | 只看该作者
不出现DRC自己都不知道短路了

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12#
 楼主| 发表于 2017-5-4 17:35 | 只看该作者
7 A- e2 ^) l. o$ P
元件如果放到底层,top和bottom层怎样区分?
, z7 {8 |+ R0 d3 D0 V

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不明白你要说什么?? 放哪层就是哪层啊  详情 回复 发表于 2017-5-5 19:56

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13#
发表于 2017-5-5 17:27 | 只看该作者
一般一个板子允许短路的地方不会很多,允许短路的地方自己做的板子自己心里很清楚,把允许短路的drc隐藏即可,搞得那么麻烦!

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14#
发表于 2017-5-5 19:56 | 只看该作者
finezhang 发表于 2017-5-4 17:35# {" [: r" J/ ^. o
元件如果放到底层,top和bottom层怎样区分?
& |6 U7 h: A9 J2 a
不明白你要说什么?? 放哪层就是哪层啊
' U6 y% o; D" _) Z( {9 b  T3 [

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已搞定,谢谢大侠耐心讲解!  详情 回复 发表于 2017-5-5 18:11

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15#
 楼主| 发表于 2017-5-5 18:11 | 只看该作者
superlish 发表于 2017-5-5 19:56
* V! X8 u  A, r* l1 @4 @不明白你要说什么?? 放哪层就是哪层啊
0 [: {2 I5 G# Y4 X% n; x' z
已搞定,谢谢大侠耐心讲解!
" G/ H' o" M1 B+ F  n

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