allegro 16.6 如何设定不同Net 短路时又不会出现DRC

finezhang · 发表于 2017-5-4 12:26

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请问大虾allegro 16.6 如何设定不同Net 短路时又不会出现DRC？

yangjinxing521 · 发表于 2017-5-4 13:11

晕。。乱来。。

superlish · 发表于 2017-5-4 13:37

短路肯定有DRC的，没有DRC才是有问题的。
建议最好留着DRC，你可以不用理会它，防止后面忘记了，有个DRC可以知道的

不同网络如果需要短接，你如果不想出现DRC，可以另起一层（非走线层）画个线短接，
但是你设置光绘时候记得把这个线设进去，否则走线层没有这个线生产出来是开路的

superlish · 发表于 2017-5-4 13:50

短接点建议可以建个封装，（记住不要开窗，这个不需要焊接的），前后网络可以不一样，中间画个线（非走线层）端接即可，光绘设置时记得把那个非走线层的线设置加进去，否则就不链接了。

finezhang · 发表于 2017-5-4 13:58

superlish 发表于 2017-5-4 13:507 c. D- V1 C4 ]5 O5 M4 Y7 K$ M! A+ b
短接点建议可以建个封装，（记住不要开窗，这个不需要焊接的），前后网络可以不一样，中间画个线（非走线层 ...

请教在哪层画线，出gerber时怎样添加这一层？强行连接DRC没办法出gerber

superlish · 发表于 2017-5-4 14:57

强连也可以出GERBER的
最好自己定义单独一层，防止和其他信息冲突

superlish · 发表于 2017-5-4 15:08

finezhang 发表于 2017-5-4 13:58# z$ |) Q) \+ L
请教在哪层画线，出gerber时怎样添加这一层？强行连接DRC没办法出gerber

请问下你这个有在原理图上有标示出来的吗？最好原理图也标一下，要不下次改版或者换别人做就不清楚这里强连是什么意思了，别人估计会当做短路处理了。

superlish · 发表于 2017-5-4 15:22

还有一种短接的，铜靠近点，弄最小间距不报错就OK，然后开钢网，一刷锡膏就连上了

finezhang · 发表于 2017-5-4 15:39

没有明白怎样在封装里面：添加2个中间画个线（非走线层）
333层怎样添加的

superlish · 发表于 2017-5-4 16:14

finezhang 发表于 2017-5-4 15:39& k. B* ]% A4 J8 g
没有明白怎样在封装里面：添加2个中间画个线（非走线层）$ V( Y" R1 X! |$ Q+ \
333层怎样添加的

红尘2938 · 发表于 2017-5-4 16:57

不出现DRC自己都不知道短路了

finezhang · 发表于 2017-5-4 17:35

superlish 发表于 2017-5-4 16:14

元件如果放到底层，top和bottom层怎样区分？

這侽孓譙悴丶 · 发表于 2017-5-5 17:27

一般一个板子允许短路的地方不会很多，允许短路的地方自己做的板子自己心里很清楚，把允许短路的drc隐藏即可，搞得那么麻烦！

superlish · 发表于 2017-5-5 19:56

finezhang 发表于 2017-5-4 17:35& C" n" k1 t# f# b9 |5 }
元件如果放到底层，top和bottom层怎样区分？

不明白你要说什么？？放哪层就是哪层啊

finezhang · 发表于 2017-5-5 18:11

superlish 发表于 2017-5-5 19:56
- U# d) P- g0 m9 T. F不明白你要说什么？？放哪层就是哪层啊

已搞定，谢谢大侠耐心讲解！

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