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求教:传导骚扰测试超标如何解决

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1#
发表于 2017-2-21 18:49 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 chenzhouyu 于 2017-2-21 18:52 编辑
5 V( s8 p- v) A/ v
$ e" i. O# R. e, Y: v5 A4 x# r' q大家好!( S  r9 Z4 ~; m. W, h2 R
求教个问题,有个产品传导骚扰测试超标,晶体的频率是16MHz,超标的频点都是晶体的谐波频率。2 E4 g( v: e! _' h& l' A  V
是什么原因引起的呢?有什么办法可以解决吗?先谢谢大家!6 q6 q+ o& D0 ]4 Y: J$ H
- O4 O/ T, a: F0 c
6 s$ Z( A9 d/ U% j

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2#
发表于 2017-3-4 12:19 | 只看该作者
电源没处理好,每组加些偶合电容,还可以试试加电感、磁珠、MCU功耗都顶小可以串个2欧以上的电阻减小电源干扰。
' W1 Q+ |0 y  m6 h1 P5 o如确认是晶振引起的,LAYOUT时晶振5MM方圆不走其他线

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3#
发表于 2017-3-4 12:20 | 只看该作者
你直流电过啥传导

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4#
发表于 2017-3-22 13:47 | 只看该作者
1.时钟加串阻;2.时钟并小电容;3.时钟内存参考平面化画单独的地平面。

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5#
发表于 2017-3-31 10:54 | 只看该作者
晶振的GND,包含负载电容的GND不要和表层GND相连,走内层

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6#
发表于 2017-3-31 11:06 | 只看该作者
看你的布局,晶振可以左挪,靠近IC一点。挺像晶振通过GND影响到整个GND 平面

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7#
发表于 2017-3-31 15:05 | 只看该作者
晶振靠近IC,表面的线尽快短,晶振下不要布除地以外的信号线。

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8#
发表于 2017-4-6 15:16 | 只看该作者
感觉你的晶振可以放在离IC更近的位置。晶振范围内不要铺铜,不要走线。

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9#
发表于 2017-4-21 11:47 | 只看该作者
可以查看下PWM部分电路

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10#
发表于 2017-4-27 19:19 | 只看该作者
问题解决了吗?大家也都是猜猜看的,不知道究竟怎么解决的,呵呵!

点评

我换8M晶体就好了  详情 回复 发表于 2017-4-27 22:33

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11#
 楼主| 发表于 2017-4-27 22:33 | 只看该作者
eddiemoon 发表于 2017-4-27 19:19! {3 X$ z0 G2 L; X8 _8 m
问题解决了吗?大家也都是猜猜看的,不知道究竟怎么解决的,呵呵!
5 }: r5 K' ~0 o% L5 u$ i# u- Q0 p: ^
我换8M晶体就好了7 e+ |9 t1 G8 |* w/ P5 J3 f( A

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12#
发表于 2017-8-29 16:18 | 只看该作者
最简单可行的办法就是降低晶振的频率
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