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[HyperLynx] 关于pin和die上的波形问题。

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发表于 2016-9-6 12:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 color_ 于 2016-9-6 12:03 编辑
. L, ?8 Z! {4 c
  O) k) D6 P) C在输出一个ddr2 800 的波形时,pin上和die上波形相差很大,pin上波形出线非单调(有回沟),而die上的波形则没有," n, L& b; y$ N$ q
修改走线对回沟没明显改善。3 V  K, y: s% y( g6 \! B
9 w8 I! }* P( l( \4 ?
单根数据线波形。
+ n' Z/ M( z( i: F3 u7 k% W! w5 C/ A7 D
6 }& h& W" {' w0 K. u: C: T, Z0 {pin上的波形( |1 B" m7 ?( P/ D! g; t% Y
2 I* P0 t+ b) N" j
9 `9 _7 _' O2 ~, z/ o# R) M' a( D7 i
. v' ~. H! F/ |5 P3 R2 K
die上的波形1 f. H$ j; L0 I$ {

' _: M- E, ^8 ?% I* [2 u, Z* W3 w) k( h! m. L: D; o/ D
想了解一下,是否一般以die上的波形还是已pin上的波形来判定信号是否合格。2 {& G5 w+ `7 J; G& z- h
) e. S0 O; u2 W) ^
然后就上升(下降)沿上产生回沟是因为封装的原因吗?
" L0 n4 ^9 x5 B& X( j
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    开心
    2022-11-1 15:51
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    [LV.6]常住居民II

    2#
    发表于 2016-10-13 12:17 | 只看该作者
    我觉得是要看die上的波形, 因为最终的信号是在die上面进入内部电路。也有人说只要pin上面的波形符合标准就可以,pin的die芯片公司设计保证可行的,我不是很同意。

    该用户从未签到

    3#
    发表于 2016-10-14 18:20 | 只看该作者
    PIN仿真用在要求不高的场合,要求高的话,需要在模型中加上一句语言,DIE的仿真就会很准了,因为在要求不高情况下,PIN和DIE的仿真相差不大的

    该用户从未签到

    4#
    发表于 2016-10-14 18:23 | 只看该作者
    在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,

    点评

    能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。  详情 回复 发表于 2016-10-17 16:42
    了解了,感谢大神指导。  详情 回复 发表于 2016-10-17 11:15

    该用户从未签到

    5#
     楼主| 发表于 2016-10-17 11:15 | 只看该作者
    ytmgadw 发表于 2016-10-14 18:23  T1 X6 j7 B4 W; f: f* h) R
    在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,
      l' G2 `* Z3 h
    了解了,感谢大神指导。
    * t4 `) I1 ]8 `6 e5 M: U. N! ]

    该用户从未签到

    6#
     楼主| 发表于 2016-10-17 16:42 | 只看该作者
    ytmgadw 发表于 2016-10-14 18:23' x$ o( [+ \# `7 H
    在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,

    6 W1 ]+ a2 C6 |: q) i( ]6 a5 A能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。
    " t9 U, H  w2 h* w

    该用户从未签到

    7#
    发表于 2017-2-20 14:38 | 只看该作者
    DDDDDDDDDDDD
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