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[HyperLynx] 关于pin和die上的波形问题。

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发表于 2016-9-6 12:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 color_ 于 2016-9-6 12:03 编辑 1 e# g1 u- V2 t: A5 r5 n) ]& r1 a% c, g

4 P$ U& v4 x+ d8 R% O) i5 @3 m在输出一个ddr2 800 的波形时,pin上和die上波形相差很大,pin上波形出线非单调(有回沟),而die上的波形则没有," Y$ C6 G% k- n( W
修改走线对回沟没明显改善。
* R% s& T8 |) |% p& m& H& G" m
5 G9 E! S7 p: i单根数据线波形。4 r/ C  C' M: z$ [$ D
2 i0 U" H5 G+ \2 Z$ u% K7 G
pin上的波形$ \9 P0 w  G0 S7 J- U+ X% z

2 V% N& N. X. t* H( o7 Y* j5 D/ d4 q$ Y! l# P; j; n: A( d5 I( h( l
2 _) V6 R6 g1 w3 _, M
die上的波形. F& N7 k2 i' ]# ^. ^5 B* N
- Q/ `) I+ l$ L( P) Z0 j

. A2 M8 W; l0 w+ _3 Q想了解一下,是否一般以die上的波形还是已pin上的波形来判定信号是否合格。
0 S8 |) f" ^& s: h% p5 }8 [) K3 b0 \3 Y+ c
然后就上升(下降)沿上产生回沟是因为封装的原因吗?
$ q$ @* d- I: q7 o) D+ m
  • TA的每日心情
    开心
    2022-11-1 15:51
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    [LV.6]常住居民II

    2#
    发表于 2016-10-13 12:17 | 只看该作者
    我觉得是要看die上的波形, 因为最终的信号是在die上面进入内部电路。也有人说只要pin上面的波形符合标准就可以,pin的die芯片公司设计保证可行的,我不是很同意。

    该用户从未签到

    3#
    发表于 2016-10-14 18:20 | 只看该作者
    PIN仿真用在要求不高的场合,要求高的话,需要在模型中加上一句语言,DIE的仿真就会很准了,因为在要求不高情况下,PIN和DIE的仿真相差不大的

    该用户从未签到

    4#
    发表于 2016-10-14 18:23 | 只看该作者
    在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,

    点评

    能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。  详情 回复 发表于 2016-10-17 16:42
    了解了,感谢大神指导。  详情 回复 发表于 2016-10-17 11:15

    该用户从未签到

    5#
     楼主| 发表于 2016-10-17 11:15 | 只看该作者
    ytmgadw 发表于 2016-10-14 18:239 f0 @! G, n! v" \8 [
    在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,
    4 F" F/ U+ g( ^" i8 M
    了解了,感谢大神指导。
    : i8 F" F, }9 A7 |/ [& \/ D

    该用户从未签到

    6#
     楼主| 发表于 2016-10-17 16:42 | 只看该作者
    ytmgadw 发表于 2016-10-14 18:23
      _; F7 {! P2 `5 J* o在模型中加一句语言Timing Location die就可以解决了,也可以在在帮助文件中找到,
    & T1 ~/ A8 M7 ^2 m- d1 b0 d
    能否具体指明一下在那份文档中吗?help文档太多,找起来有点吃力。。( P  k2 }+ B( r+ Y

    该用户从未签到

    7#
    发表于 2017-2-20 14:38 | 只看该作者
    DDDDDDDDDDDD
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