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[Cadence Sigrity] Sigrity PI仿真 AC/DC

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1#
发表于 2016-9-2 17:12 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 clovep 于 2016-9-2 17:22 编辑 2 k) r" n1 |7 T4 ?

0 m& E' n: r" f  }/ @自学PI半年多时间(本身Layout),现在可以完成基础:3 i1 @/ z% U, ]! L! E1 G1 H
                               AC : PDN仿真,DC:IR-drop
3 q8 G: e- ?8 ]  {, [) q0 L- f$ E
+ G1 F6 F1 f( u. S! R1.AC仿真中PDN目标阻抗是按照电压波动的百分比(例如:3%)来计算,
% o/ Q2 S( G5 M) A3 f( _/ K* }5 V4 w   DC仿真中IR-Drop也是按照电压波动百分比(3%)来仿真。如果两个都8 K4 E# ~  x& E" A# E1 T* \. {2 e
   处于临界点3%,那最后的结果为什么不是6%呢?
8 c/ X; `# N  T5 f: [! |) j- f2.PCB部分可完成的pnd优化一般是在10K-100M频率范围内,现在做的项目通过仿真发现pnd一般都是在30M之前是满足目标阻抗,30M之后开始超过目标阻抗。
9 c- O( I7 [( \$ A: E; P  这种状况下电源文波通过测试,还是在要求波动以内。这个截止频率该如何具体量化呢?是需要后续的SSN噪声仿真来确定是否ok吗?- y0 G  {& p1 h3 Q
. s. j% G; j- ?4 ?
望高手帮忙解答。不胜感激!. G/ N/ |+ ^7 v3 J. s- @, F* N
$ I! R: d2 m8 h/ k( @- n

该用户从未签到

2#
发表于 2016-10-27 09:25 | 只看该作者
新手,同求解答; m% e9 W: u6 M" |' U9 W

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3#
发表于 2016-11-23 10:22 | 只看该作者
同为新手学习,互勉一下哈~~

该用户从未签到

4#
发表于 2016-11-29 10:39 | 只看该作者
只会IRDrop,还没接触过PDN,也希望学习下

该用户从未签到

5#
发表于 2018-4-3 14:02 | 只看该作者
POWER SI 试下

该用户从未签到

9#
发表于 2018-5-14 09:28 | 只看该作者
选对IBIS模型,很多基本元器件选ESpice模型就够了,没有必要完全追求原厂IBIS模型。0 o" n4 r% S  g3 h* e! c1 S' x0 `8 T; k
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    [LV.6]常住居民II

    11#
    发表于 2018-11-27 14:30 | 只看该作者
    截止频率100M也是按照经验值来设置的吧
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