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EDA365电子论坛网»电子社区 › 研发技术版块 › 硬件设计讨论 › 74AHC32 的逻辑图，最后加了两级的非？
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74AHC32 的逻辑图，最后加了两级的非？

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Quantum_

该用户从未签到
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1#
发表于 2016-8-29 21:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
如下图.  为何， 74AHC32 的逻辑图的最后加了两个非。% d1 m  ^- T) [
1. 不加， 逻辑上也正确。
# l4 z0 ^; A* t% h( H* K, W2. 为了增加延迟吗？; ^3 b$ G5 z7 ^' D1 ^+ \) A5 g
3. 还是为了驱动TTL?
- N6 x2 y6 F. C/ w* q# O& y
3 W! M/ S; r: M谢谢！

OR.png (11.62 KB, 下载次数: 0)

OR logic Diag

OR logic Diag

点评

支持！: 5.0
超級狗
支持！: 5
可以送我 2TB 的硬盤嗎？^_^  发表于 2016-8-30 11:19

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超級狗

该用户从未签到
3#
发表于 2016-8-29 23:36 | 只看该作者
jacklee_47pn︰% O% @$ |$ p8 V, z$ g" k8 p% l
讚 !
9 n8 X( |5 n5 `8 a' O& ?

' R6 W/ c* J2 s0 d/ S  U$ I1 d看！% y! a( C, Y0 p8 S! g6 ~5 ]; _* P

' @7 w9 [9 _6 e' H% E  g5 ^3 U8 f

% s4 O" ?7 F% V# h沒有啦！我是叫大家看內容。
' O5 i6 E# ^6 ?; p/ y9 @/ I5 K( [/ ]( `2 E

点评

jacklee_47pn
也對！ 要用力看，努力看，好好看！ ^_^  发表于 2016-8-31 07:49

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hliu0129

该用户从未签到
5#
发表于 2016-9-21 17:07 | 只看该作者
4楼这个图片，比楼主的问题亮得多。个人认为是同步时序。

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