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DDR SDRAM绕等长

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发表于 2016-7-4 08:12 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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有谁有关于DDR、SDRAM绕等长的资料呢,求分享
/ T  e1 H, [) z2 X: S+ Y
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    开心
    2020-5-19 15:39
  • 签到天数: 10 天

    [LV.3]偶尔看看II

    2#
    发表于 2016-7-4 09:05 | 只看该作者
    你想知道什么呢??等长间的误差吗??

    点评

    越详细越好,要是有原理说明就更好了,比如上升沿采样等?  详情 回复 发表于 2016-7-4 10:10
    频率 等长误差一般设置范围等  详情 回复 发表于 2016-7-4 10:09

    该用户从未签到

    3#
     楼主| 发表于 2016-7-4 10:09 | 只看该作者
    980155498cai 发表于 2016-7-4 09:05) z# e2 D- \+ i
    你想知道什么呢??等长间的误差吗??
    ; j3 }+ M5 i- H
    频率  等长误差一般设置范围等, a  H& F% G/ Z7 f' d

    点评

    SDRAM速率不高,误差可以大一点50mil左右,  详情 回复 发表于 2016-7-4 10:55

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    4#
     楼主| 发表于 2016-7-4 10:10 | 只看该作者
    980155498cai 发表于 2016-7-4 09:05
    - }+ ^0 k8 G8 F! d1 s( Y你想知道什么呢??等长间的误差吗??
    ) r& K2 d9 g  T6 [) H
    越详细越好,要是有原理说明就更好了,比如上升沿采样等?$ T4 A+ H5 `/ ?2 V+ z$ ~3 N9 Q
    ' b9 u, h. Z0 h  W" `3 g' B% X) C
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    5#
    发表于 2016-7-4 10:55 | 只看该作者
    shipaopao 发表于 2016-7-4 10:09! A- v& I' Q$ q, d* n
    频率  等长误差一般设置范围等

    ; U- i: q2 |4 ~: K3 V" _SDRAM速率不高,误差可以大一点50mil左右,

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    6#
    发表于 2016-7-4 11:23 | 只看该作者
    我也想知道,来看看

    该用户从未签到

    7#
    发表于 2016-7-4 16:14 | 只看该作者
    数据10mil,地址20mil

    该用户从未签到

    8#
    发表于 2016-7-5 17:03 | 只看该作者
    同一组内DQ与DQS的走线延时差异不得超过+/-5ps
      l0 K; B5 `) _3 q1 c# F地址、控制信号与CK的走线延时差异不得超过+/-25ps2 ]- w0 D# i* C9 D( z
    对每个DDR3芯片,CK必须晚于DQS到达,延时差值范围0~250ps        我一般data±5 add±100
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    奋斗
    2020-6-24 15:43
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    10#
    发表于 2020-4-1 15:31 | 只看该作者
    数据、地址、控制信号
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