DDR3调不通

980155498cai · 发表于 2016-5-23 12:31

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DDR3调试不同，主要的原因在哪呢？信号走线都没有任何问题。

djadfas · 发表于 2016-6-6 12:29

本帖最后由 djadfas 于 2016-6-6 12:30 编辑

都回答的什么玩意？

很明显是DDR配置文件有问题
不要动不动就说电源阻抗什么的

我飞漆包线 DDR都能跑起来

xeon · 发表于 2016-5-27 11:39

根据经验，DDR出现问题主要是上电时物理层初始化通不过，原因包括：
1、电源有问题。如供电电压不对，参考电压没供上，电源纹波太大；
2、时钟有问题。时钟如频率不对，波形失真严重；
3、信号完整性问题。如端接不正确、等长不规范、走线被严重干扰；
4、芯片焊接问题。

说书人 · 发表于 2016-5-29 11:34

根据经验，DDR出现问题主要是上电时物理层初始化通不过，原因包括：, H$ M8 u3 I% _2 \ 1、电源有问题。如供电电压不对，参考电压没供上，电源纹波太大； 2、时钟有问题。时钟如频率不对，波形失真严重； 3、信号完整性问题。如端接不正确、等长不规范、走线被严重干扰；- ^. Q0 y [) G$ J5 G 4、芯片焊接问题。

cmgkuku · 发表于 2016-5-24 14:16

上图，没有layout,是不知道具体的原因的

980155498cai · 发表于 2016-5-27 13:34

xeon 发表于 2016-5-27 11:39) i0 m$ P# A9 L; P7 A
根据经验，DDR出现问题主要是上电时物理层初始化通不过，原因包括：
9 E4 U. W6 e6 C1、电源有问题。如供电电压不对，参考 ...

谢谢您给我的建议，我会按照您的方法在试试

980155498cai · 发表于 2016-5-27 13:34

xeon 发表于 2016-5-27 11:39
2 D5 w7 ?2 z6 B0 w u, S! v* J根据经验，DDR出现问题主要是上电时物理层初始化通不过，原因包括：
- C/ }& D' y$ v6 q1、电源有问题。如供电电压不对，参考 ...

谢谢您给我的建议，我会按照您的方法在试试

980155498cai · 发表于 2016-5-29 13:09

等长和走线均无问题，也没有跨分割现象，端接匹配的是50Ω的，不知道是不是应该接36Ω，焊接的话目前没有办法去查看，时钟也处理的很好，电压时1.35V，暂时怀疑是参考电压太远了，还在排查

HOHO · 发表于 2016-5-31 15:44

频率多少，降频试过吗？

ljzyhjbfwh · 发表于 2016-5-31 17:36

是否可以跑training看一下，看fail在哪个地方。

980155498cai · 发表于 2016-5-31 18:22

HOHO 发表于 2016-5-31 15:448 m0 i( A; r. p0 l1 x! T9 z
频率多少，降频试过吗？

问题基本找到了，是FPGA的问题

980155498cai · 发表于 2016-5-31 18:22

ljzyhjbfwh 发表于 2016-5-31 17:362 h* n7 g" B0 V; o) z
是否可以跑training看一下，看fail在哪个地方。

问题基本找到了，FPGA的程序有点问题

ljzyhjbfwh · 发表于 2016-6-1 10:07

是初始化程序不对吗还是setting设置的不对？

liangkai520 · 发表于 2016-6-3 17:48

你是怎么确认你的DDR有问题

980155498cai · 发表于 2016-6-4 22:22

最后确认为FPGA的问题目前正在修改这部分，

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