新人贴求助：FPGA与AD DA DDR的交互布局怎么做？

ms7021 · 发表于 2016-3-4 21:25

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最近新上一块板子，IO用的比较多，在画PCB的时候发现交叉严重，几次修改过后板子加到8层还是很紧张不够合理，求助有经验的前辈怎么处理，或者说有什么方法可以提前避免走线交叉严重的问题。

Projectaker · 发表于 2016-3-5 16:22

你先从原理图入手，根据预设的PCB布局先思考怎样的走线比较好。对于多个IO进行group设定，然后在画板时使用swap进行操作，最后由PCB导出的网表更新你原理图的网表。

ms7021 · 发表于 2016-3-4 21:27

好吧，自己先顶一个

zqy610710 · 发表于 2016-3-5 15:07

FPGA io口换网络呀，首先得搞清楚FPGA的换网络原则

Projectaker · 发表于 2016-3-5 16:22

更好的答案，等待......

ms7021 · 发表于 2016-3-5 17:27

感谢各位的指点，我去试试

jyl518 · 发表于 2016-3-5 17:30

也想知道原因

TCCZY · 发表于 2016-3-7 08:50

一般会选择换PIN

TCCZY · 发表于 2016-3-7 08:50

一般会选择换PIN

ms7021 · 发表于 2016-3-9 17:44

zqy610710 发表于 2016-3-5 15:073 {5 ~4 s+ R6 v; z
FPGA io口换网络呀，首先得搞清楚FPGA的换网络原则

第一次做FPGA的板子，IO换网络很头大，通常有什么原则？

zqy610710 · 发表于 2016-3-11 08:43

ms7021 发表于 2016-3-9 17:44
1 f- `5 e0 M, @9 a; p2 ]6 c8 \" \4 [第一次做FPGA的板子，IO换网络很头大，通常有什么原则？

要看这个芯片的资料手册呀！

歪头歪脑 · 发表于 2016-4-12 16:49

看看

dzkcool · 发表于 2016-4-13 08:26

一般FPGA同一个Bank内的没有特殊功能的数据线是可以互换的，有的相同电平的数据线甚至可以跨Bank互换，以FPGA的数据手册说明为准。

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