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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › Cadence Allegro教程资料区 › allegro PCB 层与层的铜皮为何会避开过孔？
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allegro PCB 层与层的铜皮为何会避开过孔？

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xm_smallp

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1#
发表于 2016-2-17 09:54 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如图，相同的网络，我在L1层和L3层使用了铜皮，并通过过孔连接，但是铜皮会自动避开过孔，) [4 h9 N2 ^1 j$ a
不知在allegro中该如何设置，还请知道的朋友指导下，非常感谢！+ s! b% [: ]0 a9 D/ V% `
6 F0 G- |- P0 ~

/ U7 Q$ J% L9 @# }9 u! P2 n8 t  v

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fengyelyl

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2#
发表于 2016-2-19 10:36 | 只看该作者
你可以把L1和L3的铜皮加大，包住过孔！

点评

xm_smallp
嗯嗯，谢谢！  详情 回复 发表于 2016-2-19 17:02

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xm_smallp

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3#
 楼主| 发表于 2016-2-19 17:02 | 只看该作者
fengyelyl 发表于 2016-2-19 10:36
$ S: ~2 Q, Y2 k1 r你可以把L1和L3的铜皮加大，包住过孔！
' H5 I, ^, u, E3 t$ u$ D4 _
嗯嗯，谢谢！
7 a& `2 w% \% _& p. A4 w1 J4 v

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