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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 铺铜问题~求助
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铺铜问题~求助

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Aiby2015

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1#
发表于 2015-6-10 11:05 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x

* J" @. Y& w2 A为什么会有这样的错误（是动态铜了）？下面是drc- r7 C$ N1 B' S: F* g* f  |
https://www.eda365.com/forum.php? ... mp;extra=#pid911826$ ^$ k6 b3 \% T5 O8 f; s- ?$ y& k# q
, I) u3 P% `1 l! r) C

) Z/ }' N1 R; j9 b! O5 T* p6 F2 s' S/ S9 B
  y/ J( D. i7 {! k# ?
LISTING: 1 element(s)
5 s* x" C% b6 ~  p- Z4 U; |' {! i
5 G; M2 k5 ~2 i$ a7 X) r& E           < DRC ERROR >
! U: h$ P% v% V
0 b& |+ S9 G3 p/ Q1 `; A7 \  Class:           DRC ERROR CLASS( L  u: b. c, [7 q; O! _  x, c
  Subclass:        TOP
4 `2 O2 U2 W8 f! c( O4 E9 T) W  Origin xy:       (2096.00 2275.00)% s. ^# c/ M8 {. L9 X9 ~
  Constraint:      Line to Shape Spacing- w& m% I4 Q& t4 f1 U/ |* B
  Constraint Set:  DEFAULT
! [' E' a  s9 v" E4 Y  Constraint Type: NET SPACING CONSTRAINTS
4 o, \# w$ Y) a
7 o- L' B9 ~4 d; o, [  Constraint value: 10 MIL! n- J# S" W4 W& k  g* D- }. l
  Actual value:     0 MIL) Y! l/ D+ k7 A# H' k

& k  R1 u5 c( |8 ~( c; c& p7 T. i  - - - - - - - - - - - - - - - - - - - -& q2 H8 I+ h/ j" P& L$ N) M
  Element type:    SHAPE
: d* j; k$ D* `# K- g. H% Q  Class:           ETCH4 J5 U- e* P+ Z+ ?% S
  Subclass:        TOP
- c6 F( y7 g6 g
- f4 r9 V1 V1 E( a. X4 M, P  t5 x1 Q  On a Dummy Net
, g8 ?0 `' ?, U0 R* m: ]6 G# {9 x# B7 H- N  L: R
  - - - - - - - - - - - - - - - - - - - -
+ _- N- V0 w- {- ^0 n% m  Element type:    HORIZONTAL LINE SEGMENT
7 Z7 j# Z9 P' n- m9 o  Class:           ETCH$ Q4 I, t: l3 J" v4 @0 \
  Subclass:        TOP
& w! v  N: q8 t
& p+ j) J+ V5 F9 z4 q  part of a connect line/ w% q8 e8 f8 n/ v1 Z7 Y
  Part of net name: TXD
! J8 X; q; R) Q/ j" ~
3 N! F2 X) R8 m2 j5 v* `. g, Jsegment:xy (2096.00 2275.00) xy (2203.00 2275.00) width (10.00)4 _4 W, d) \2 S1 e1 R7 d8 J1 P

2 p/ w) c' w4 }! f/ v& N

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3dworld

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发表于 2015-6-17 09:24 | 只看该作者
dzkcool 发表于 2015-6-16 13:20( P  {7 C8 _$ G8 W+ b2 f
你这跟楼主不是同一回事啊，确定走线的网络跟管脚是同一个吗？
- y" F6 D. C# {
谢谢杜老师提示，网络跟管脚不是同一个。我走线的时候，忘记勾选find内的pin选项了。! C' f' ^; p: {. p
应该是在top层走了一段连接线，所以报错。
  e; [& Q' p7 C6 W. J. ]8 o8 o- ]3 m* U勾选上pin选项，就没有错了，问题解决。
- S+ h7 A% ~2 z( a ( P# F% {) S- q, T

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Aiby2015
解决了就好  详情 回复 发表于 2015-6-18 14:36

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3dworld

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发表于 2015-6-16 13:15 | 只看该作者
Aiby2015 发表于 2015-6-16 10:386 R8 l9 E0 F  e1 K3 [
可以了吗？
( ?) S' D! P  _& n+ {8 z; t: h9 ]
没有解决。
6 X" R1 j& J) ]! c" s我的是在top 层出现的Line to SMD Pin Spacing 的DRC error
" L* s+ E8 D' h应该是我哪里弄错了。
' t  P& g3 f- i$ H$ f8 ~+ v, P 8 r) h0 U% \$ s& B
- {/ ?7 w; R# ^) K* O% B

8 K* \( L) B- v, I

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kinglangji
  • TA的每日心情
    衰
    2020-7-21 15:38

    • 签到天数: 21 天

    [LV.4]偶尔看看III
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    发表于 2015-6-10 11:19 | 只看该作者
    本帖最后由 kinglangji 于 2015-6-10 11:21 编辑 7 V3 h0 ~, w) F8 r; p  F
    Aiby2015 发表于 2015-6-10 11:06  w  @/ o+ P& D
    allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

    . i9 I. O1 b- p  s  K7 j。。。。。。。貌似这样好像不出drc。。- o( O) F- v* ]" n; K9 O

    捕获.JPG (60.37 KB, 下载次数: 13)

    捕获.JPG

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    Aiby2015
    [attachimg]98046[/attachimg] 然而并没有什么*用~~~  详情 回复 发表于 2015-6-10 12:20

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    Aiby2015

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    2#
     楼主| 发表于 2015-6-10 11:06 | 只看该作者
    allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

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    kinglangji
    。。。。。。。  详情 回复 发表于 2015-6-10 11:19

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    Aiby2015

    该用户从未签到
    4#
     楼主| 发表于 2015-6-10 11:49 来自手机 | 只看该作者
    好 我试试看

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    Aiby2015

    该用户从未签到
    5#
     楼主| 发表于 2015-6-10 12:20 | 只看该作者
    kinglangji 发表于 2015-6-10 11:19
    3 |" R: T7 s6 [; p- U& H+ P( [/ m。。。。。。。貌似这样好像不出drc。。

    3 ], ~4 N$ Y1 l* p7 Z+ |
    ! ?' ]" H! {0 Z: M9 e0 k然而并没有什么*用~~~- r' P+ [2 F" d! O  R! o) x; b7 |: D

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    3dworld

    该用户从未签到
    7#
    发表于 2015-6-15 09:51 | 只看该作者
    我遇到了类似的问题，查看的约束管理器，觉得里面设置是对的。
    : C6 ?5 b1 y6 F. R3 p同求答案。

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    Aiby2015
    我的解决了 不知道您的是不是？  详情 回复 发表于 2015-6-15 20:06

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    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    8#
    发表于 2015-6-15 13:23 | 只看该作者
    不行就上传文件

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    Aiby2015
    感谢杜老师私下热心 指导  详情 回复 发表于 2015-6-15 20:07
    Aiby2015
    好了  详情 回复 发表于 2015-6-15 20:02

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    Aiby2015

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    9#
     楼主| 发表于 2015-6-15 20:02 | 只看该作者
    dzkcool 发表于 2015-6-15 13:23
    . [! _; p5 x. o) [不行就上传文件

    ! V$ _& d3 {+ h, F好了
    3 H6 ]# O. C- _. L
    + ^$ o8 q" `7 U% l* ^2 D7 \6 r, ~

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    Aiby2015

    该用户从未签到
    10#
     楼主| 发表于 2015-6-15 20:05 | 只看该作者
    * v% {8 n3 s' X8 R
    我犯了低级错误，负片敷铜！! |( S0 D% m4 B

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    Aiby2015

    该用户从未签到
    11#
     楼主| 发表于 2015-6-15 20:06 | 只看该作者
    3dworld 发表于 2015-6-15 09:51/ }) ~5 [* D. X! V  X' ]7 s
    我遇到了类似的问题，查看的约束管理器，觉得里面设置是对的。
    ) s; X* I% G- D) v6 u; W同求答案。

    : u# |3 o3 h# r  b4 ]% s5 y9 a* h' z我的解决了 不知道您的是不是？% @  M/ L+ Y9 r# F; U* [9 N/ K

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    3dworld
    我去试试看， 负片不能普通吗？ 在创建铜皮的时候，不是通常给负片Power层指定网络吗？  详情 回复 发表于 2015-6-16 09:37

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    Aiby2015

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    12#
     楼主| 发表于 2015-6-15 20:07 | 只看该作者
    dzkcool 发表于 2015-6-15 13:23
    . b. g1 D) {5 V9 S不行就上传文件
    3 h# n- W! a: j% [
    感谢杜老师私下热心 指导
    2 c+ t) P1 z$ a$ b# H4 {+ ]

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    3dworld

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    14#
    发表于 2015-6-16 09:37 | 只看该作者
    Aiby2015 发表于 2015-6-15 20:067 o/ D. \/ o: o" S
    我的解决了 不知道您的是不是？
    ) M; h  q& n0 j9 y
    我去试试看，
    " z0 n; G% c! `负片不能普通吗？
    4 q* L( v3 e& m' A8 D在创建铜皮的时候，不是通常给负片Power层指定网络吗？
    5 s+ K. ~* w9 g  J; k  @  Z1 Q

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    Aiby2015
    可以了吗？  详情 回复 发表于 2015-6-16 10:38
    dzkcool
    楼主是把表底层设置成了负片。  详情 回复 发表于 2015-6-16 10:32

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    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    15#
    发表于 2015-6-16 10:32 | 只看该作者
    3dworld 发表于 2015-6-16 09:37; |3 b  G& o# L5 N9 E" h1 U
    我去试试看，
    $ N' t0 A0 m+ M) V5 u8 k6 U负片不能普通吗？
    5 z* [+ R4 x9 _9 i在创建铜皮的时候，不是通常给负片Power层指定网络吗？

    + o2 g' o7 _4 z% y2 H: r) @楼主是把表底层设置成了负片。
    5 I" x3 ]6 ]1 j. |& ^, [( n4 Q: r8 Z

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