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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 铺铜问题~求助
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铺铜问题~求助

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Aiby2015

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1#
发表于 2015-6-10 11:05 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
, U2 S: v. H* U& \9 ^0 O
为什么会有这样的错误（是动态铜了）？下面是drc
4 `" Z, |" G, @. |  H/ ihttps://www.eda365.com/forum.php? ... mp;extra=#pid911826" d- _0 m9 O" `7 V

/ f7 s, [* f, L; {4 m  a" z4 V% J1 y( i3 Z4 E7 o; E% S' t* }# L

* {8 ^9 Q7 ?4 U' R- w- n  F, I3 X! |) v  C" j! w# h- `! K/ l
LISTING: 1 element(s)
* y' _+ a3 ^* s5 p6 V/ j  ~3 o/ `2 ~( j
           < DRC ERROR >
' a( v8 R" E9 J  m' Y' T; J  W: g; Y8 M$ |# i9 J# b
  Class:           DRC ERROR CLASS
/ U4 P" J0 x, `0 Q! g& c& ~  Subclass:        TOP$ B' p/ c7 V2 \. ^5 a/ D3 ^
  Origin xy:       (2096.00 2275.00)# ?0 `: k2 V; u! t+ U% j
  Constraint:      Line to Shape Spacing
; i# @0 y, m, U! h) [  Constraint Set:  DEFAULT
9 k  z& _0 G9 e8 n7 B0 T& Q$ b  Constraint Type: NET SPACING CONSTRAINTS& l' y" H- w( n2 _  O
& |( B2 D# A. G. }
  Constraint value: 10 MIL
& x. d  ~% ^/ g/ t& r, `  Actual value:     0 MIL* J1 M' a$ ?- C' B/ W; @( O# W
0 E& \7 u& l5 _( M
  - - - - - - - - - - - - - - - - - - - -- e; J% ]. e0 Y
  Element type:    SHAPE
( {- c* v' J8 f' t4 n  Class:           ETCH' E- ~: j, _; k  @) F, h
  Subclass:        TOP
1 X6 K8 J4 B4 f0 A$ Q! `. r
! V% \$ ]. W" T8 `  On a Dummy Net9 J  y+ {8 D5 }1 B& j% `" L% \% e7 ?' `, q

& y; a# o& g6 x. r. g  - - - - - - - - - - - - - - - - - - - -- E+ Q  w% u3 Q# X) M) q" L
  Element type:    HORIZONTAL LINE SEGMENT
+ x) ?6 l+ o" x  Class:           ETCH
" t% G% @* P+ ?  Subclass:        TOP6 _4 X$ u& y4 ]- a- [
5 U/ Y5 b) `5 R* L2 k
  part of a connect line" O  B. {& o- q0 ?8 a1 l
  Part of net name: TXD( u4 j; I' H1 @- F" E) T

6 ]' Y# |. p& X4 u# Hsegment:xy (2096.00 2275.00) xy (2203.00 2275.00) width (10.00)" c1 Z% E$ w! d

' \8 n- I# P$ v6 |- K: h$ C

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3dworld

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发表于 2015-6-17 09:24 | 只看该作者
dzkcool 发表于 2015-6-16 13:20
; R1 s+ c$ P6 F: _你这跟楼主不是同一回事啊，确定走线的网络跟管脚是同一个吗？
- |( H3 y1 S; P" N
谢谢杜老师提示，网络跟管脚不是同一个。我走线的时候，忘记勾选find内的pin选项了。1 Y4 M/ D6 _8 p- X1 g$ W0 h
应该是在top层走了一段连接线，所以报错。7 Q, H/ G/ V9 y
勾选上pin选项，就没有错了，问题解决。. R: f: |, |. S6 [! J

; p) y7 S1 n# f3 u) [" v

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Aiby2015
解决了就好  详情 回复 发表于 2015-6-18 14:36

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3dworld

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发表于 2015-6-16 13:15 | 只看该作者
Aiby2015 发表于 2015-6-16 10:38
: W( {0 X9 F$ z1 B% W可以了吗？

& |# O, N& k8 s7 W  U7 I没有解决。) \( t# ^8 F8 Y
我的是在top 层出现的Line to SMD Pin Spacing 的DRC error0 B7 s* V0 n. J# ^8 E" L: @7 K; Y
应该是我哪里弄错了。
2 g+ s% a4 _, y$ k- t. J' L- Y + `0 O  X' H( e
3 E* s; h, w$ a
1 X, X( f3 j, q6 c

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kinglangji
  • TA的每日心情
    衰
    2020-7-21 15:38

    • 签到天数: 21 天

    [LV.4]偶尔看看III
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    发表于 2015-6-10 11:19 | 只看该作者
    本帖最后由 kinglangji 于 2015-6-10 11:21 编辑 6 U, k4 z" Y7 V% G8 E2 c
    Aiby2015 发表于 2015-6-10 11:06. }. t6 g  ^+ l) g
    allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

    4 ~8 S; ~$ ~/ H- K3 ~5 `( L3 w) v" o。。。。。。。貌似这样好像不出drc。。
    8 R5 m1 }+ W3 n, H

    捕获.JPG (60.37 KB, 下载次数: 17)

    捕获.JPG

    点评

    Aiby2015
    [attachimg]98046[/attachimg] 然而并没有什么*用~~~  详情 回复 发表于 2015-6-10 12:20

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    Aiby2015

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    2#
     楼主| 发表于 2015-6-10 11:06 | 只看该作者
    allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

    点评

    kinglangji
    。。。。。。。  详情 回复 发表于 2015-6-10 11:19

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    Aiby2015

    该用户从未签到
    4#
     楼主| 发表于 2015-6-10 11:49 来自手机 | 只看该作者
    好 我试试看

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    Aiby2015

    该用户从未签到
    5#
     楼主| 发表于 2015-6-10 12:20 | 只看该作者
    kinglangji 发表于 2015-6-10 11:19  e2 U1 }& _; w1 q* ]1 N- c% S! I- O. S
    。。。。。。。貌似这样好像不出drc。。
    * k7 `' ^+ g: H$ Z/ G# c2 ]& w
    9 a0 i; o* o9 ^( o
    然而并没有什么*用~~~( J8 l- y. [; Z

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    3dworld

    该用户从未签到
    7#
    发表于 2015-6-15 09:51 | 只看该作者
    我遇到了类似的问题，查看的约束管理器，觉得里面设置是对的。/ j9 _5 K0 c8 l8 w$ p
    同求答案。

    点评

    Aiby2015
    我的解决了 不知道您的是不是？  详情 回复 发表于 2015-6-15 20:06

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    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    8#
    发表于 2015-6-15 13:23 | 只看该作者
    不行就上传文件

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    Aiby2015
    感谢杜老师私下热心 指导  详情 回复 发表于 2015-6-15 20:07
    Aiby2015
    好了  详情 回复 发表于 2015-6-15 20:02

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    Aiby2015

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    9#
     楼主| 发表于 2015-6-15 20:02 | 只看该作者
    dzkcool 发表于 2015-6-15 13:23
    4 F2 O$ W2 h* g1 J6 ~" |4 E% a不行就上传文件

    # W% `) Y8 p( c& ?' h" R好了
    + w, J, R; `; K7 T. q7 H6 S# j' D! \) w7 K  [; r% |

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    Aiby2015

    该用户从未签到
    10#
     楼主| 发表于 2015-6-15 20:05 | 只看该作者
    - |1 l0 h" a: q/ [: l
    我犯了低级错误，负片敷铜！8 [7 @9 }+ ^' h9 \" f+ }

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    Aiby2015

    该用户从未签到
    11#
     楼主| 发表于 2015-6-15 20:06 | 只看该作者
    3dworld 发表于 2015-6-15 09:51- i  h2 p/ H6 V
    我遇到了类似的问题，查看的约束管理器，觉得里面设置是对的。
    . M. o4 n$ k" U7 l% {. h, x! o同求答案。
    3 o- J! W" L5 K
    我的解决了 不知道您的是不是？
    6 X+ P+ s. R% l

    点评

    3dworld
    我去试试看， 负片不能普通吗？ 在创建铜皮的时候，不是通常给负片Power层指定网络吗？  详情 回复 发表于 2015-6-16 09:37

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    Aiby2015

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    12#
     楼主| 发表于 2015-6-15 20:07 | 只看该作者
    dzkcool 发表于 2015-6-15 13:23; F! r9 [# o( s6 r' j
    不行就上传文件

    6 F( N) K. Z" p" j" R" ]感谢杜老师私下热心 指导( x& y9 q' V0 y9 M

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    3dworld

    该用户从未签到
    14#
    发表于 2015-6-16 09:37 | 只看该作者
    Aiby2015 发表于 2015-6-15 20:06
    ; w* m5 N* \7 O' w# m8 ]1 D我的解决了 不知道您的是不是？
    - ~  @% R: V. i# z$ T7 }
    我去试试看，
    ( B9 L1 |1 o* z. ?% e负片不能普通吗？
      S$ D( G5 A! x在创建铜皮的时候，不是通常给负片Power层指定网络吗？# Y: x: q& W, }9 @5 ]% U- \

    点评

    Aiby2015
    可以了吗？  详情 回复 发表于 2015-6-16 10:38
    dzkcool
    楼主是把表底层设置成了负片。  详情 回复 发表于 2015-6-16 10:32

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    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    15#
    发表于 2015-6-16 10:32 | 只看该作者
    3dworld 发表于 2015-6-16 09:37
    ! G5 l$ {6 s2 Z6 d+ f- A0 d我去试试看，% j0 \7 Q" s, V" k5 w" L
    负片不能普通吗？" I& E7 c# a" Q6 |1 |; a9 ~' h. [. E
    在创建铜皮的时候，不是通常给负片Power层指定网络吗？
    / l( S- h) c8 M4 ?6 }7 v; u* k0 \
    楼主是把表底层设置成了负片。
    ; {; j* ?4 ?" q8 f" j. P" r

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