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最近遇到一个非常头疼的EMC问题,我开发的的一款电话机静电过不了!

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1#
发表于 2015-5-30 14:23 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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最近遇到一个非常头疼的EMC问题,我开发的的一款电话机静电过不了!不知各位大虾有什么好的处理办法?

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发表于 2015-5-31 22:22 | 只看该作者
接口部分电路布线及复位线、中断信号线或者边沿触发信号线需特别处理. 接口部分电路最易受$ E' e7 r5 U! g, O- b6 J
到ESD 的干扰. 所以,通常在接收端放置瞬态保护器,从连接器出来的信号线和地线要直接接到瞬态
0 _2 `' B+ H- n; ?保护器,然后才能接电路的其它部分,瞬态保护器的接地端用短而粗的线(长度小于5 倍宽度,最好小
7 j4 B) r9 B# b5 F# R- L- k) Y于3 倍宽度)连接到机箱地;接收端放置串联的电阻和磁珠,以部分吸收ESD 产生的能量;连接器处或( D2 F1 A( y/ F! V5 P/ D5 Y" O
者离接收电路25mm 的范围内,要放置滤波电容,同样,信号线和地线先连接到电容再连接到接收电
- _' ]0 ~+ L7 R路,电容的接地端用短而粗的线连接到机箱地或者接收电路地(长度小于5 倍宽度,最好小于3 倍宽
6 a4 P4 V! h6 r8 G5 `1 s0 C* ]: e度);要确保信号线尽可能短,信号线和相应回路之间的环路面积尽可能小. 对于长信号线每隔几厘米7 |  Z  `0 Y* t  e0 g# B
或几英寸调换信号线和地线的位置来减小环路面积. 因为复位线、中断信号线或者边沿触发信号线当- v* s; g; @/ w' W4 _
受到ESD 干扰时状态最容易改变,而造成设备锁死、复位、数据丢失等现象. 故要特别注意复位、中断' }( p( x1 o9 t9 x& }  d
和控制信号线的布线要采用高频滤波并远离输入和输出电路和电路板边缘.

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2#
发表于 2015-5-30 21:37 | 只看该作者
要解决电话机的电磁兼容问题,必须有效准确的定位干扰源和干扰途径,可以用屏蔽来抑制电磁辐射,可以用隔离的手段来解决静电和群脉冲问题。电话机一般由单片机为主芯片,外接一定的转换芯片!不知楼主在打静电时打到哪里会有问题,是在面板、按键还是电话线入口处!采用的是对空气15kv放电还是8kv放电?是塑料壳还是金属面板?

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3#
发表于 2015-5-30 21:48 | 只看该作者
在解决静电问题时应做到屏蔽和疏导两种措施并举。另外也可以通过软件来解决静电问题。必要时机壳内部可以采用静电喷涂。另外PCB设计也是解决静电问题的必备手段和方法。增加ESD元器件也是解决电话机硬件问题的解决方法。等等----还是要具体问题具体分析。

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4#
发表于 2015-5-31 16:08 | 只看该作者
最好能把你的问题说清楚点,比如把report贴出来,或者是说明下你的测试的点等等

点评

确实!如果有截图就更好了!  详情 回复 发表于 2015-5-31 22:02

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5#
 楼主| 发表于 2015-5-31 21:47 | 只看该作者
谢谢!我们的产品是一个塑料外壳,主要是打15KV对空气放电不过,没有做静电喷涂,四层板,不知EMC在PCB上还有没有改善的空间?

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6#
发表于 2015-5-31 21:54 | 只看该作者
《PCB防静电设计》
6 r5 \! B3 X0 y/ B# [/ E3 ?1、缩小环路面积。变化的磁通穿过电路回路产生感应电流,引起电路参数变化。因此设计时应采取措施缩小环路面积。
8 k7 I8 u$ Q9 h- O2 Y' r3 X2、信号线尽量短。长的导线易接收到更多频率成分信号干扰,影响信号质量。
9 l  L8 M1 A0 u0 V  T4 u' n5 J3、大面积使用地面线。在没有布置器件、线的区域大面积使用底面线。抵消静电放点源上的电荷,减小静电场对信号线的影响,避免静电对无器件的冲击。2 l( T- T& p4 K& K* t
4、加强电源线和地线之间的电容耦合。& }+ i3 n: ~; x; M: B+ p  L' l
5、隔离电子元件与静电放电电荷源。  B) i- o* ?" m
6、 PCB上的机壳地线的阻抗要低且隔离要好。  ]  B4 g* q' }

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7#
发表于 2015-5-31 22:01 | 只看该作者
1.复位线、中断信号线或者边沿触发信号线不能布置在靠近PCB 边沿的地方;* Y  _& K! ]1 @( v4 Q
2.将PCB 上未使用的部分设置为接地面;
4 ~# u8 s+ @) s3.机壳地线与信号线间隔至少为2 毫米;- H2 `* E, Y& U# ^" K
4.用TVS 二极管来保护所有的外部接口;布线应该先经过TVS管。1 {3 s' w3 T0 q  O' I, \- s
5.确保每一个电路尽可能紧凑。尽可能将所有连接器都放在一边。I/O 电路要尽可能靠近对应的连接器。
/ ~8 i5 H3 H+ |! Q6 C$ T0 W/ }, |" x% e, X$ A2 C7 {4 ?
不知这些措施能不能帮到你!
, ^* B6 B0 z) \2 S9 F
2 P7 v; L+ Z0 O9 L/ ]/ x! p  l; R
8 O/ O3 b" j1 p/ v# l3 B" e9 Q

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8#
发表于 2015-5-31 22:02 | 只看该作者
菩提老树 发表于 2015-5-31 16:089 L' I# K' {/ K
最好能把你的问题说清楚点,比如把report贴出来,或者是说明下你的测试的点等等
% a" M: Y% C" h+ Y# y6 {, Z
确实!如果有截图就更好了!1 t! ~4 j3 b0 b1 j2 g! |/ o

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10#
发表于 2015-6-1 16:50 | 只看该作者
打静电应该有具体位置吧?

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11#
 楼主| 发表于 2015-6-6 14:16 | 只看该作者
感谢各位大侠的答复!在大家的指导下,我对PCB设计来解决静电问题有了一定的了解!我们现在研发的是一款智能终端设备,里面有CPU、以太网交换芯片等。主要是在网口的地方对空气放电有问题,面板上也有问题。目前正在改版设计中。

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12#
发表于 2015-7-15 11:25 | 只看该作者
楼主现在什么状况?公告一下子啦~

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13#
发表于 2015-7-15 19:00 | 只看该作者
ESD方面的设计,哪位大侠有这方面的文档或者书籍推荐哈
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