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求Verilog的仿真测试激励文件编写指导

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发表于 2015-5-25 17:59 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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求Verilog的仿真测试激励文件编写指导
' S0 U3 F' n! J* Q2 [6 C

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3#
 楼主| 发表于 2015-7-2 14:24 | 只看该作者
sccedi 发表于 2015-7-1 14:553 }4 H9 Y; E7 D- x) t$ L0 O' Z1 ^7 l
同求

( A/ F! H' J8 T0 N# o3 l/ J! V《Verilog-HDL实践与应用系统设计 》我看了一周 发现不错
# O9 ^) E3 J# a  V4 u  ^; R

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5#
发表于 2015-7-6 11:10 | 只看该作者
找EDA工作室出的一本verilog验证的书,是我看到的最好的一本书。作者好像是王诚与什么继华。

点评

全名叫什么啊?我去看看  详情 回复 发表于 2015-7-8 14:02

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6#
 楼主| 发表于 2015-7-8 14:02 | 只看该作者
lg2841 发表于 2015-7-6 11:10
9 u0 ^6 ]  l+ n+ c找EDA工作室出的一本verilog验证的书,是我看到的最好的一本书。作者好像是王诚与什么继华。

" }2 Q7 W4 Z8 U9 S7 b全名叫什么啊?我去看看, U: x9 B* m8 }4 ^+ X9 u) h
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