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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 求助，allegro层叠显示优先级设置
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求助，allegro层叠显示优先级设置

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zhuoxuan26

该用户从未签到
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1#
发表于 2015-5-21 11:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
5金币
求助，allegro层叠显示优先级设置, q+ Q. W/ x% _0 w! v3 p  C2 H4 v% ], Y
铺铜后会出现丝印被挡住的现象，而又不想半透明铺铜，请问各位大大，allegro怎么调整层叠的显示优先级？. m% v9 V/ o7 C% S3 h
如图，allegro中铺铜后会挡住丝印层
" K; w6 K% ?7 ]7 j
' p% s# z0 z, c$ X; m! A2 w5 t3 ?6 Z( Z' j1 l% `, ~

' I) r: k( T; Q) h5 W7 T% S4 n$ ~: q而altium designer 或者protel里面不会出现这种问题，如图' I5 A4 v2 j3 Q7 L) J

' ^2 ]8 _/ H( O* J1 l: m8 n8 O' B

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dzkcool

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啥也不说了，直接上图：

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dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    2#
    发表于 2015-5-21 11:31 | 只看该作者
    啥也不说了，直接上图：
      b2 z$ A$ C/ Q  a
    + Q8 A; m% e6 }

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    zhuoxuan26 + 1 很给力!

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    kinglangji
  • TA的每日心情
    衰
    2020-7-21 15:38

    • 签到天数: 21 天

    [LV.4]偶尔看看III
    3#
    发表于 2015-5-21 13:26 | 只看该作者
    支持一下~dzk版主V5~~

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    辉辉辉辉

    该用户从未签到
    4#
    发表于 2015-5-22 08:32 | 只看该作者

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    bingshuihuo

    该用户从未签到
    5#
    发表于 2015-6-1 22:34 | 只看该作者
    支持一下~dzk版主V5~~

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    antoni2011

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    6#
    发表于 2015-6-2 08:51 | 只看该作者
    看到……。顶了

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    jacekysun

    该用户从未签到
    7#
    发表于 2015-6-2 09:12 | 只看该作者

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