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制作通孔类焊盘的内电层设置问题

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1#
发表于 2015-5-14 14:58 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 六子联方 于 2015-5-14 15:04 编辑 0 s& l1 b" h3 }( l3 Z8 u

; L$ m% v* k0 c
. j. j7 L2 ?6 I8 j2 I0 }- A
8 b+ `8 e: g* z, `
请问,对于四层板的PCB,我的焊盘需要设置2个内电层吗?如下图红色框出的部分:
# x$ w5 F8 P$ ~) T$ D
0 R  R1 G; P; {4 _* y& `
% y4 B9 H, O! W( B4 e/ c

5 D" {- J: V8 f% A4 \, o6 {. m1 R8 Q如果不需要设置2个内电层,只需要一个default internal即可,那么请问软件可以添加多个内电层的实际工程意义在哪里啊?2 t! h: ~$ U, |+ G

! u. Z9 w! `/ C9 x, b& F* T$ N  h
5 e/ I4 [5 d1 x2 l3 r5 a
如果需要设置2个内电层,那么请问:对于一个DIP元件如果我本来是用于4层PCB板中,那么我需设置2个内电层。但是某一天我需要把这个元件用在6层板中,那么我需要对这个元件的每个通孔焊盘进行修改,将2个内电层修改成4个内电层?
; P% P8 e; N$ M3 [' S4 {5 o6 l) ~, b6 W$ S# ^0 {  C! E) }

: l5 ]! _/ ~/ |, t6 N; H9 e7 q) Z 关于我上面提出的疑惑,在21IC里面有类似的问题(但是未有明确答案)
/ J) g/ _; r" n' Z3 }) Z) k& B1 W  m网址:file:///C:\Users\ADMINI~1\AppData\Local\Temp\%W@GJ$ACOF(TYDYECOKVDYB.png
http://bbs.21ic.com/icview-396805-1-1.html # g( h0 v) s5 W7 c9 j! J
% _  b$ `6 q7 _! s8 x1 V5 U$ v
( P* S- ?- m8 T/ e+ l

" m7 ?: ^3 g$ J2 S2 ^' j% B7 h2 b# O2 f; s
  L$ q, [/ ]6 U9 r9 n' V5 B- l4 b' ~
, z( L2 D7 l, I( k3 P/ L; |

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2#
发表于 2015-5-14 15:05 | 只看该作者
我是这么理解的:表层和底层是必备的,所以需要专门设置,至于内层应该调用的是Defualt Internal的设置,所有的内层(可以是4层,也可以是8层)应该都是使用的这个配置,如果在具体的板子上你有特殊的设置,你单独编辑就可以了。

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3#
发表于 2015-5-14 15:09 | 只看该作者
本帖最后由 deargds 于 2015-5-14 15:16 编辑 / Z/ _3 W# Z4 K

  a7 M& X2 d0 {只需要一个default internal即可,只有在手工建立盲埋孔的焊盘时才需要根据叠层添加相应的内电层。

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4#
 楼主| 发表于 2015-5-14 15:22 | 只看该作者
本问题在EDA365 Allegro交流QQ群已经解答。特别需要感谢@deargds@yangyabo02 的耐心解答。
% \0 _" Y2 S& A2 }

! J' c" {+ ~9 H6 ?3 [理解如下:
% a' u7 F: {0 C& \; K' J    也就是说对于DIP等通孔类焊盘,不管PCB是多少层,我在制作焊盘的时候只需要设置一个default internal就可以了。而对于制作BB Via,则需要根据实际PCB的层数和走线设置不同的内电层。 % E5 j$ O& e3 ?$ x
% M# _# |# P' d( N8 a% ~
  • TA的每日心情

    2020-7-21 15:38
  • 签到天数: 21 天

    [LV.4]偶尔看看III

    5#
    发表于 2015-5-14 16:51 | 只看该作者
    其实不光是bb via。8 N7 C( R4 P& _* B3 v
    default internal就是导入板子后,所有找不到对应层的层,都用default的设置。,; P8 T# v# b" }  O
    但是如果有对应的层,就用对应的层,比如一个电源层和一个底层,你想让这两层
    + g8 M2 G5 E& M9 J- w3 P的antipad不一样大,那就可以让对应的层区别开。

    点评

    anti pad 大小不一样,能够明显看出来吗?或者怎么查看?谢谢了  详情 回复 发表于 2015-5-16 23:31

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    7#
    发表于 2015-5-16 23:31 | 只看该作者
    我正受这个问题的困扰,学习了。+ t! N; Q1 G4 f2 D
    3 C1 \9 ]. y; a( Q: s( v" }
    制作pad时,我增加了GND、POWER 层,保存的时候,有警告。一开始我以为设置没有问题,是软件没有考虑到使用请,我错了。
    ' v( p/ G( }, q/ L0 HPADSTACK WARNINGS:
    # i8 E. l1 G6 l5 ]8 ~. n0 H  d1 p5 D; G2 s# R* {# X* @( r
    INTERNAL LAYERS: are defined for this padstack.; T) e+ s5 d, x+ ^
    When loading this padstack into a design, only the internal, I1 L/ \! C  d/ U, R3 Z
    layers with names matching those defined in the design will
    / _! Y( ~" W. E' W/ ?7 ^8 ube used.

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    8#
    发表于 2015-5-16 23:31 | 只看该作者
    kinglangji 发表于 2015-5-14 16:51# ~% ], d. r  }* u7 L0 N
    其实不光是bb via。: Y% i; U  t0 z4 D1 n; Q/ g
    default internal就是导入板子后,所有找不到对应层的层,都用default的设置。,5 d/ i" d. ^! Y7 X3 h  F$ n& C7 }
    但 ...

    # {: u- }7 {8 h: X9 ^5 j0 kanti pad 大小不一样,能够明显看出来吗?或者怎么查看?谢谢了& J& r: W* V( `, C( x: J

    4 w9 ?0 Z& ]6 J  J8 A0 f7 u
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