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[Cadence Sigrity] SigXplorer中Rel Prop Delay问题

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1#
发表于 2015-3-27 15:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
allegro中,CPU到DDR的线,设置了XNET和T点,走线完成后,在显示等长数值的地方看 没有数值,黄色。
! H1 E2 b+ Q1 \3 x# i有几根线的在SigXplorer中看,没有设置模板,要这么解决,坐等回复
( L8 j; t6 i/ g4 k* V8 ^3 r, Z; O' A7 {4 J- m- N
点Cmgr图标等长处显示:
) n1 R1 F; X% [" _- m9 m' d' S. ^+ _" m7 o, c
在SigXplorer查看,正确的地方为:: U; ]5 H& x7 \+ N9 K1 P

& d2 x4 d% l1 \7 a, P- X% l  a
  W. E: d, `+ d. q9 ]. |异常的网络为:
% L: t' ]4 d+ m/ ` , S8 i0 T0 |8 C! E  B

9 J6 Q. ?3 O2 s$ s0 ~1 I7 o

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2#
 楼主| 发表于 2015-3-27 15:31 | 只看该作者
就是同一组等长,设置模板没有到其中的2个网络。要怎么解决

该用户从未签到

3#
 楼主| 发表于 2015-3-30 16:54 | 只看该作者
最后用最原始的方法,删除T点和XNET再重新设置了
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