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请教cadence设计层次电路图如何更新框图?

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1#
发表于 2015-3-4 21:04 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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cadence capture设计好的层次式电路中,若修改了子电路部分,如何更新它对应的上一层框图,或是根层框图?谢谢!9 U1 g- e2 C4 Q/ Y- Z% ]3 r$ y( L

该用户从未签到

2#
发表于 2015-3-16 21:28 | 只看该作者
更新仅针对PORT上下不对应,如果你只是更新内容,没有改动port,可以不管。更新方法,在上层的block上选中-右键,选择synch up/down,当然这两个不能点错,up是从子图更新上层block,down是从block更新子图的port,自己试试就知道了。

点评

这个方法不错!!!  详情 回复 发表于 2015-4-27 14:09
谢谢!  详情 回复 发表于 2015-3-19 09:19

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3#
 楼主| 发表于 2015-3-19 09:19 | 只看该作者
kevin890505 发表于 2015-3-16 21:28
6 z' q* j( P- x4 b7 s更新仅针对PORT上下不对应,如果你只是更新内容,没有改动port,可以不管。更新方法,在上层的block上选中- ...
4 I# R5 a: W, O' t" G  N6 I
谢谢!
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4#
发表于 2015-4-3 23:13 | 只看该作者
又学习了 谢谢大神分享

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5#
发表于 2015-4-27 14:09 | 只看该作者
kevin890505 发表于 2015-3-16 21:28
2 ?: r* G# j' E! `) b9 L更新仅针对PORT上下不对应,如果你只是更新内容,没有改动port,可以不管。更新方法,在上层的block上选中- ...
5 ~7 J) R( l& H3 Q3 r0 @
这个方法不错!!!% q$ |: c" a2 s# h; }: i
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