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请教各位大侠,cadence HDL如何生成网表?

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1#
发表于 2015-2-25 09:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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cadence HDL如何生成网表?
. s. B: h9 h# @: I怎样更新到PCB啊; `' [# z3 T2 i, a6 J2 h

* c4 h1 _! x0 z& d. V
7 o& q7 a4 N. Z, U: M
  • TA的每日心情
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    2023-11-1 15:41
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    [LV.1]初来乍到

    2#
    发表于 2015-2-25 10:24 | 只看该作者
    在原理图中,file选项中export physical

    该用户从未签到

    4#
     楼主| 发表于 2015-2-25 11:39 | 只看该作者
    fishplj2000 发表于 2015-2-25 10:495 f; U. n, {4 J: J0 ^- {2 O
    楼上正确

    , ^; t5 D9 R8 m) q那怎么调入啊,我们调网表一般就是第一方 第三方(TEL/TXT格式)啊# a2 }6 G9 p: g# I' t) i
    6 H. j7 q, S: R- K: Y, V
    非常感谢!5 @6 J. ^; L: y

    该用户从未签到

    5#
    发表于 2015-2-25 13:24 | 只看该作者
    直接调用第一方网表,就是那个file-import-logic,选择那个packaged文件夹

    点评

    谢谢!  详情 回复 发表于 2015-2-26 09:01

    该用户从未签到

    6#
     楼主| 发表于 2015-2-26 09:01 | 只看该作者
    风刃 发表于 2015-2-25 13:245 K% S6 i4 }5 _- [
    直接调用第一方网表,就是那个file-import-logic,选择那个packaged文件夹

    : p9 g. Y& c3 j4 d谢谢!
    # w' Q2 j- N! \3 l
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