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请教各位大侠,cadence HDL如何生成网表?

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发表于 2015-2-25 09:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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cadence HDL如何生成网表?
4 b8 W/ t! T" m怎样更新到PCB啊
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    [LV.1]初来乍到

    2#
    发表于 2015-2-25 10:24 | 只看该作者
    在原理图中,file选项中export physical

    该用户从未签到

    4#
     楼主| 发表于 2015-2-25 11:39 | 只看该作者
    fishplj2000 发表于 2015-2-25 10:49" c# E$ f+ L" w# C6 ~6 Z
    楼上正确
    6 m' `$ V/ J' k
    那怎么调入啊,我们调网表一般就是第一方 第三方(TEL/TXT格式)啊
    * _+ E  }4 s! G- Q6 Q( t* V
    3 K# [+ S5 ^. r非常感谢!1 F/ j2 o8 s: i& `. r

    该用户从未签到

    5#
    发表于 2015-2-25 13:24 | 只看该作者
    直接调用第一方网表,就是那个file-import-logic,选择那个packaged文件夹

    点评

    谢谢!  详情 回复 发表于 2015-2-26 09:01

    该用户从未签到

    6#
     楼主| 发表于 2015-2-26 09:01 | 只看该作者
    风刃 发表于 2015-2-25 13:240 G/ i, w* [" s4 C6 A4 T2 ^$ l
    直接调用第一方网表,就是那个file-import-logic,选择那个packaged文件夹
    & w" h8 }  r7 I6 H. _& z
    谢谢!
    0 K' A/ l, l1 o' O% r2 k0 o5 C. n
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