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楼主: chisir2000
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ddr3分享一下设计。

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该用户从未签到

61#
发表于 2016-3-30 20:02 | 只看该作者
必须顶一下

该用户从未签到

64#
发表于 2016-4-19 18:35 | 只看该作者
大侠,有没有PADS的DDR设计资料啊?

该用户从未签到

65#
发表于 2016-4-20 09:06 | 只看该作者
ck与dqs有明确规范吗?

该用户从未签到

66#
发表于 2016-4-21 18:07 | 只看该作者
想下载,可惜不够分
  • TA的每日心情
    开心
    2025-7-18 15:34
  • 签到天数: 112 天

    [LV.6]常住居民II

    67#
    发表于 2016-4-29 09:09 | 只看该作者
    多谢,好好学习
  • TA的每日心情
    慵懒
    2020-11-23 15:03
  • 签到天数: 2 天

    [LV.1]初来乍到

    70#
    发表于 2016-5-26 17:26 | 只看该作者
    地址无效了/ V& h3 u& i" K9 {0 Y, T& Q$ x
  • TA的每日心情
    开心
    2020-5-19 15:39
  • 签到天数: 10 天

    [LV.3]偶尔看看II

    71#
    发表于 2016-5-27 14:40 | 只看该作者
    你不是说下载不要钱吗??为什么还收钱
  • TA的每日心情
    开心
    2020-5-19 15:39
  • 签到天数: 10 天

    [LV.3]偶尔看看II

    72#
    发表于 2016-5-27 14:41 | 只看该作者
    mintjelly_abc 发表于 2014-10-11 09:534 q5 M  P* K; s( N+ Q
    电感 L1 在2~4层对应的部分都挖空了,能解释下作用吗?
    6 }8 y4 X& C4 A& W0 L5 V# J  ?8 `
    大的电感在内层挖空是比较好的
    . g( ]. e1 w% N* H5 A" d0 q

    点评

    时间太久了,我都忘了问过这个问题了。我这边现在的处理基本上都是电感下面不走信号线,GND 和 PWR 就没有做处理。  详情 回复 发表于 2016-6-20 10:11

    该用户从未签到

    73#
    发表于 2016-6-20 10:11 | 只看该作者
    980155498cai 发表于 2016-5-27 14:41
    ' Z( F* r5 x( X+ }* X7 P大的电感在内层挖空是比较好的
    ; E* U! P: }8 z- w6 I; ]( s
    时间太久了,我都忘了问过这个问题了。我这边现在的处理基本上都是电感下面不走信号线,GND 和 PWR 就没有做处理。
  • TA的每日心情
    开心
    2020-5-19 15:39
  • 签到天数: 10 天

    [LV.3]偶尔看看II

    74#
    发表于 2016-6-20 11:06 | 只看该作者
    大的电感就是这样处理时最好的

    该用户从未签到

    75#
    发表于 2016-6-20 15:30 | 只看该作者
    下载学习,多谢分享,顶一下
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