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PADS的PCB封装的丝印应该在top层还是在silkscreen top层?

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1#
发表于 2013-8-16 16:23 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如题。

1.jpg (179.08 KB, 下载次数: 13)

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发表于 2017-5-19 13:43 | 只看该作者
我试验了(版本9.5),是这样吧:
* }7 p9 m0 }' _& U1 _" X/ T                                                                                                                                                                                           Top
( i/ P6 T  j& G, @8 x0 |1、不管封装时丝印放在<All layers>还是<Top>,导入到PadsLayout中,都会被放置在   Top    X        这里;8 q4 m/ q: ?4 x. u1 j# ^
8 I9 j% |7 l! n0 R

( t* k6 M; V" ]                                                                                                                                                                        Top! q* z0 r1 l0 ^4 K
2、封装时丝印放在<SilkscreenTop>,导入到PadsLayout中,即会被放置在   Silkscreen Top    X        这里;
" W- W. m6 k: d+ x0 x
+ i- j: d" U) z9 o5 b
: h7 V/ q! n( ^0 T- X
: F% \$ N. y  S% f* I- I: Z% G# G3 w1 Z( @
哪个对?
# j1 Z0 Z( ^- D+ }) h- S5 S

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发表于 2015-6-18 16:16 | 只看该作者
dds0201 发表于 2013-8-16 17:34
  z7 F$ k8 _# \' z+ E这个是LP的设置问题,已经晓得怎么改了。谢谢。

6 Y* r: }$ Z& {$ q请问 soldermask 和pastemask 这个怎么自动生成的时候能够不一样大小呢? 我现在必须手动改,比较烦。
( w+ h6 E* K$ ~& p1 j% r& Y! g+ l0 T& u

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发表于 2017-5-19 16:58 | 只看该作者
而且,不管封装时丝印放在<All layers>、<Top>还是<SilkscreenTop>,导入到在Pads Router中都变成了:
( t- e. g6 k- I! a7 y2 T% a

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2#
发表于 2013-8-16 16:30 | 只看该作者
silkscreen层或all layers

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3#
 楼主| 发表于 2013-8-16 16:41 | 只看该作者
cwfang2013 发表于 2013-8-16 16:30 0 f2 }+ j) n" t! |1 h' }. I
silkscreen层或all layers
4 h& B8 u/ Z) a' g3 g; C
谢谢。
( v+ I/ f. j& k9 [9 x; d在设计封装的时候如何选择all layers?

1.jpg (83.75 KB, 下载次数: 3)

1.jpg

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4#
发表于 2013-8-16 16:43 | 只看该作者
你这已经是all layers

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5#
发表于 2013-8-16 16:45 | 只看该作者
dds0201 发表于 2013-8-16 16:41 # c& F5 J: F) `
谢谢。$ {1 ^9 n$ m1 X3 I* V
在设计封装的时候如何选择all layers?
" a, m, q& N! n: u8 e6 T- R$ `$ A
多年经验建议放在 TOP 层.

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6#
发表于 2013-8-16 16:46 | 只看该作者
cwfang2013 发表于 2013-8-16 16:43 * h& v/ X1 Y/ N4 p
你这已经是all layers

: y( M0 b' p7 X3 I, W# J  n, z不要放在 all layers, 这个已经被废弃了.

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7#
 楼主| 发表于 2013-8-16 16:53 | 只看该作者
饭牛 发表于 2013-8-16 16:46 0 e" s! o' ]6 B- b
不要放在 all layers, 这个已经被废弃了.

. B' z) a$ l/ @, ]为什么要这样做呢?
  • TA的每日心情

    2019-11-19 16:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    8#
    发表于 2013-8-16 16:57 | 只看该作者
    我还是习惯放在all layers。元件位号我习惯放在表层。这个是跟你个人的习惯和出gerber的习惯有关的。

    该用户从未签到

    9#
    发表于 2013-8-16 17:15 | 只看该作者
    dds0201 发表于 2013-8-16 16:53
    : k) U0 b3 [  Z$ w0 L& V为什么要这样做呢?

    0 U# c+ |4 z* j$ z- RLP 旧版本还可以设置 All Layer, 后来新版本 All Layer 就不可以设置了, 设置 元件外框 TOP 层 和 Silkscreen TOP 在 Layout 时也有小小差别.

    该用户从未签到

    10#
     楼主| 发表于 2013-8-16 17:23 | 只看该作者
    饭牛 发表于 2013-8-16 17:15 5 z& W1 q2 ]; R! E/ n* @
    LP 旧版本还可以设置 All Layer, 后来新版本 All Layer 就不可以设置了, 设置 元件外框 TOP 层 和 Silksc ...
    ) }4 g0 R* X6 f& a, d' y, |3 ~
    LP wizard中的courtyard是指什么?

    1.jpg (14.29 KB, 下载次数: 3)

    1.jpg

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    11#
     楼主| 发表于 2013-8-16 17:29 | 只看该作者
    dds0201 发表于 2013-8-16 17:23 / s' c- ~8 h4 W6 N: q3 d
    LP wizard中的courtyard是指什么?

    , ~- }" O$ Q8 ?# e如果是自己设计封装,焊盘的阻焊能自己添加吗?我看了下LP下生成的封装全部都是soleder和paste一样大小,需要一个一个改?还是说做封装的时候不去做这个,直接在出gerber的时候添加就行了?( V9 p/ D/ i3 f% e4 f7 X" R

    1.jpg (31.91 KB, 下载次数: 2)

    1.jpg

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    12#
     楼主| 发表于 2013-8-16 17:34 | 只看该作者
    dds0201 发表于 2013-8-16 17:29
    : ]) K; A( P$ i8 {如果是自己设计封装,焊盘的阻焊能自己添加吗?我看了下LP下生成的封装全部都是soleder和paste一样大小,需 ...

      _6 N9 `0 I' I5 J+ E这个是LP的设置问题,已经晓得怎么改了。谢谢。

    点评

    请问 soldermask 和pastemask 这个怎么自动生成的时候能够不一样大小呢? 我现在必须手动改,比较烦。  详情 回复 发表于 2015-6-18 16:16

    该用户从未签到

    13#
    发表于 2013-8-16 17:40 | 只看该作者
    饭牛 发表于 2013-8-16 16:45 & i2 ~' i0 }, p+ |" t5 [6 W; c
    多年经验建议放在 TOP 层.
    $ u2 C/ S+ s- P+ p, m9 `
    此回答为标准答案

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    14#
    发表于 2013-8-16 22:06 | 只看该作者
    一开始我是放在所有层,后面我重整库放到顶层跟丝印层

    该用户从未签到

    15#
    发表于 2013-8-16 23:30 | 只看该作者
    自己设计元件时丝印放在TOP、silkscreentop以及all layer都试过,最终采用放在TOP层,原因如下:如果放在silkscreentop层,当设计多层板时需要单独观察每一层时,丝印层就会关闭,看不到元件的外框,这时需要单独再打开丝印层,不方便,而放在top层就没有这个问题,当然如果这时不需要元件的外框显示,可通过设置颜色来关闭TOP选项实现。如果放在all layer,在设置装配图时不方便,因为有些元件的装配图外框和丝印外框不同。
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