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一个关于part的管脚定义的问题

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1#
发表于 2009-2-8 12:08 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我在画ATMEGA32的part时,定义好了管脚,保存时出现 Warning: Duplicate pin name on Gate A - Logical pin 5 - Pin name VCC9 a% l5 W/ h$ t: X5 o: O+ }4 ?& u# Y

9 C8 ^% X! I$ A8 _: A) B9 h" K' B1 H5 j9 F) b& M
其意思就是我的定义的管脚名有重复了.以VCC为例.1 ~; J7 H8 S2 M! }

/ v0 s$ d2 Z# E  _
. [- ~6 i$ Z5 W' T/ [8 z解决方法:
& j  k1 ^; n* p, B; H
- e  ^3 [9 Y7 u5 g" K) P1  将原为VCC的管脚分别定义成VCC0,VCC1,VCC2,以让其不再重复.4 a% L$ L1 e. ?
# c8 y1 s; g' ^4 J; {2 G. l/ e
* z* X8 R+ ?% N& a& p. b
请问各位同仁是否还有其它方法?( Y" _: Y6 Y% h: w2 y: j

7 s  {6 V8 S$ S$ z* ~) a' u. I& x  J. N% H# t/ x

未命名.jpg (82.02 KB, 下载次数: 4)

未命名.jpg

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2#
 楼主| 发表于 2009-2-8 13:01 | 只看该作者
解法二?

该用户从未签到

3#
发表于 2009-2-9 08:54 | 只看该作者
LZ的方法是正确的。
& |9 g% G# c) `* ^8 W3 Y% V
$ V( y( k$ ^1 t, L- S还有一个方法就是添加PIN时不添加描述,然后用添加TEXT的形式也可以实现。

该用户从未签到

4#
 楼主| 发表于 2009-2-9 11:59 | 只看该作者
謝謝jimmy( w; e" V$ D9 L  H/ Q! K* b4 [

9 m1 A9 n4 }: t1 J: ]你的方法可行,作業時需要小心.
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