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allegro 17.2 怎么建立Xnet

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1#
发表于 2017-8-5 15:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
15金币
本帖最后由 tiny丨Y 于 2017-8-12 10:28 编辑 8 h5 y+ i0 Z2 }- a. r. W& |* U3 r
$ Q! ?& y6 z8 ]4 `+ ~
问题如题我不是小白
. ^# E' j; [# j. q7 I# _5 F; A用signal model assignment方法试过了,建立失败( u( T. h8 {; q9 [, H1 @; b
请用17.2试过成功的大神帮忙解决
& R4 x' ?1 ^2 r版本17.2 S094
% y$ n4 s. q9 l感谢rock_li29的帮助:可能是你的BRD文件数据有问题,提示电源和地网络有问题,重新开一个新的BRD file,把现在的器件,走线,铜皮贴到新的BRD文件可以设XNET.9 B. q" x5 P' B/ y& {+ l9 [
; V4 }$ X' u. U9 y5 W, \
! O6 \$ C6 N: z4 T5 i/ W
已确认解决,但还是没找到为啥 原来的brd不能设置 继续求助
$ @  W& q6 h6 Q; Z! V$ n; {

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附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。

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2#
发表于 2017-8-5 15:34 | 只看该作者
tiny丨Y 发表于 2017-8-7 09:44- i) j9 b5 w$ Z; d( ~
方便加个QQ2542796636 附件不好上传
8 W: A( D9 t. O( m1 M& O+ i- F
附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。1 }& f4 v8 b; ~+ C1 }

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附件  详情 回复 发表于 2017-8-8 14:45

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3#
发表于 2017-8-6 17:59 | 只看该作者
没有用过17的版本

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4#
发表于 2017-8-7 09:18 | 只看该作者
17.2的补丁已经到094了吗?

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057吧  详情 回复 发表于 2019-8-7 13:14

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5#
发表于 2017-8-7 09:33 | 只看该作者
跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。& W. S$ e' S9 N+ P2 a: r, G) V

xnet.png (47.96 KB, 下载次数: 14)

xnet.png

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方便加个QQ2542796636 附件不好上传  详情 回复 发表于 2017-8-7 09:44

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6#
 楼主| 发表于 2017-8-7 09:44 | 只看该作者
rock_li29 发表于 2017-8-7 09:334 W4 z6 o! K7 d, j/ }- i
跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。

; m7 J' A! B- \' S# g方便加个QQ2542796636 附件不好上传

点评

附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。  详情 回复 发表于 2017-8-8 10:14

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7#
 楼主| 发表于 2017-8-8 14:45 | 只看该作者
本帖最后由 tiny丨Y 于 2017-8-8 15:01 编辑 1 Y- L# X+ t. O$ o
rock_li29 发表于 2017-8-8 10:14
! r. Z  e+ v6 P2 C附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。

1 A: q6 f" v- X' L' _0 }# {私信你了

pcb.zip

1.22 MB, 下载次数: 32, 下载积分: 威望 -5

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8#
发表于 2019-8-7 13:14 | 只看该作者
zuoanwind 发表于 2017-8-7 09:18
1 @1 K  ^6 R9 ?) ?17.2的补丁已经到094了吗?
7 w( ~: m! \8 q3 B, b1 {, u
057吧3 _  y- J% N+ B2 k

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9#
发表于 2019-8-8 05:59 | 只看该作者
17.2的问题。

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10#
发表于 2019-8-8 06:07 | 只看该作者
不方便截图,这是新找到的,是17.2的问题8 I0 n9 x+ W0 V0 t. H
$ v$ P# w5 V$ y3 H! p
1.Close the design if it is open in Allegro PCB Editor.
' c- L; d( i% c0 J) a# ?2.Add the CDS_XNET_STATE_UI variable​ with a value of 1 to the User variables section in the Environment Variables form.
5 A2 {/ o3 R  h: i5 P! \# S/ E3.Open the design in Allegro PCB Editor.
# m5 v! U9 D( m7 m, s+ p) c4.Go to File > Import > Logic and, if not already set, set the Import Logic Type to Design Entry HDL.% d0 g5 Z2 g) ?! o6 U: B% d3 M* h1 D
5.Open Constraint Manager.
$ e0 ~& n" g% s  j- m6.Select Tools > Options.1 L1 ]1 {5 S. G% C7 ~* j$ R" X4 _4 z
7.Select the Create XNets and Differential Pairs using DML Models (same as SPB 16.6) option.
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    2022-11-28 15:00
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    [LV.1]初来乍到

    11#
    发表于 2019-10-28 11:40 | 只看该作者
    今天我也是遇到了,17.2不能创建XNET。。。
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    [LV.1]初来乍到

    12#
    发表于 2019-10-28 11:45 | 只看该作者
    版本17.2 S094  能分享下S094的补丁?

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    13#
    发表于 2019-10-28 19:55 | 只看该作者
    試試.謝謝!
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    14#
    发表于 2020-3-13 11:44 | 只看该作者
    THANK YOU.
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    15#
    发表于 2020-3-17 13:41 | 只看该作者
    谢谢分享
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