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一般做封装时要做Assembly_top吗?

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1#
发表于 2013-3-19 10:59 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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x

: i; P- p) y8 p. Z& H, t5 X0 E如上图,一般你们做封装时会做Assembly_top吗?& O# Q1 r2 ?  }/ u
还是只做以下两个就OK了?
% T# \: O. _2 ~7 m$ _0 v
. R  K/ o- d. B4 d0 L

点评

建议做上去!  发表于 2013-3-19 11:03

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11#
发表于 2013-3-20 14:18 | 只看该作者
有总比不没有好,等你需要用到这层的时侯,再修改就麻烦了。# r) t2 q, \3 T

, }6 V; a/ y6 x1 \, l所以尽量都加上,一般是器件形状,方向和其它一些注脚.

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10#
发表于 2013-3-19 22:14 | 只看该作者
没有必要,但是画上去的话,可以用assembly层出装配文件给装配人员,毕竟有一些板子器件密度太高,用丝印层很难看清楚。

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9#
 楼主| 发表于 2013-3-19 14:54 | 只看该作者
我认为必须画的两个.1,place-bound-top& s7 m  n# j  v! j! D' L. A- Z
                            2,silkscreen-top
# P+ o5 O" o/ g% V3 s) x这两个画了就OK了,有不同见解的吗?

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8#
发表于 2013-3-19 14:29 | 只看该作者
我一般画原件实际外框

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7#
发表于 2013-3-19 13:19 | 只看该作者
本帖最后由 幸福万岁 于 2013-3-19 13:27 编辑 9 M6 Y( F9 X/ ~* E2 r! Y

& a9 G6 A- f" e+ i, Q5 Z: v$ x- `- i装配层    比如有些需要外接器件可以多画个place_bound_top
& R$ X# I; e) G  e7 ?貌似一样
  i1 \* K1 v+ O/ u这一层 我从来不画

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6#
 楼主| 发表于 2013-3-19 13:15 | 只看该作者
inspiron1501 发表于 2013-3-19 12:32
3 D. A! m. ?6 ~看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可
2 O8 p: g+ H9 o. `0 f# W+ x& }
那按正规流程走,这层应该画什么东西?

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5#
发表于 2013-3-19 12:32 | 只看该作者
看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可

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4#
 楼主| 发表于 2013-3-19 12:27 | 只看该作者
Assembly_top这个出gerber时貌似用不上啊,还是只是设计时方便做一些标示?

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3#
 楼主| 发表于 2013-3-19 11:58 | 只看该作者
必要?
  • TA的每日心情

    2021-8-2 15:01
  • 签到天数: 37 天

    [LV.5]常住居民I

    2#
    发表于 2013-3-19 11:39 | 只看该作者
    Assembly_top是实体大小. m- t3 S6 ^" ]' @# m
    可用来给机构确认或是标示极性脚位用2 k0 i* i) i$ D# a( ]9 s
    我目前遇见的此层是必要的
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