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DDR布线的常见知识归纳

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 楼主| 发表于 2025-3-7 17:33 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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* z8 P) x8 Q1 j  m
/ M- t) Y6 V7 Q7 X% n1 ^; C
了解 DDR 的各个信号功能与网络名。! j1 [' c3 L! H9 f4 F3 |
与 DDR 相比,DDR2/3 最大差别多了功能 OTD 与 OCD。1 A) B$ w7 \# t& Q
重要信号线8 g5 x, g" E+ {+ u7 F
1.DQS 信号:, _* g& R; `% |3 z( I
DQS 是 DDR SDRAM 中的重要功能,它的功能主要用来在一个时钟周期内准
; ]$ d- o2 Z# |确的区分出每个传输周期,并便于接收方准确接收数据。每一颗芯片都有一个7 h- |( y% h1 Z+ Q5 E
DQS 信号线,它是双向的,在写入时它用来传送由北桥发来的 DQS 信号,读6 N9 ~/ U6 @5 p$ R2 T
取时,则由芯片生成 DQS 向北桥发送。完全可以说,它就是数据的同步信号$ S, E( V+ L  @) R, ^* k
2.CLK 信号:4 [5 X2 T- {8 Q" g9 j- n
DDR SDRAM 对时钟的精确性有着很高的要求,而 DDR SDRAM 有两个时
2 \# K+ d, E. n钟,一个是外部的总线时钟,一个是内部的工作时钟,在理论上 DDR SDRAM
& t! {5 g8 D% u6 F7 m+ P; }) m这两个时钟应该是同步的。1 V4 t' N" `$ e- i5 |
二.分组设定7 ]1 x6 f% ?1 D1 o) r! n1 ~8 U+ c$ r% g
数据组的分组应该以每个字节通道来划分,DM0、DQS0 以及 DQ0~DQ7 为第
* P- \" }0 @, e( X& W% s& b3 w1 字节通道,DM1、DQS1 以及 DQ8~DQ15 为第 2 字节通道,以此类推。每个* d+ O; |9 ]( n+ M  v# I
字节通道内有严格的长度匹配关系。其他信号走线长度应按照组为单位来进行
( ^  x& C$ N% P9 S; }匹配,每组内信号长度差应该严格控制在一定范围内。不同组的信号间虽然不- E: Q  J8 G- b( Z: p* F+ `
像组内信号那样要求严格,但不同组长度差同样也有一定要求;数据信号组的
+ V* l0 Z; a, Z! x. X- |# ^" Q3 n布线优先级是所有信号组中最高的,因为它工作在 2 倍时钟频率下,它的信号3 ]+ O0 m" J, f; n* F
完整性要求是最高的。另外,数据信号组是所有这些信号组中占最大部分内存
) f+ @# l7 I' F总线位宽的部分,也是最主要的走线长度匹配有要求的信号组。5 i! L. U% }- q( h3 s; f! b
$ T2 P6 B% x7 y
DDR3.pdf (540.75 KB, 下载次数: 6) 2 ~  w$ [( F+ X. g3 `4 Y% R8 D+ K7 Z

" r: w0 t2 K. A. ]+ Y7 r# C: P
) A% G( O& @- n) L5 h
( N% z# S; n9 \: s9 I% V7 I$ y

点评

免费注册,注册就得50元  发表于 2025-3-7 17:36

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参与人数 1威望 +5 收起 理由
超級狗 + 5 少了故意安插的廣告會更好!

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该用户从未签到

1#
发表于 2025-3-7 17:35 | 只看该作者
免费注册,注册就得50元

点评

谢谢分享!: 5.0
谢谢分享!: 5
咱家附近的「石二鍋」,該不會就是您開的吧?^_^  发表于 2025-3-8 11:16

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参与人数 1威望 +5 收起 理由
超級狗 + 5 不用註冊就給五兩銀!

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