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新人求助,关于原理图生成PCB

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  • TA的每日心情
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    2021-3-4 15:31
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    [LV.4]偶尔看看III

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    1#
    发表于 2020-8-5 09:01 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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    本帖最后由 夕照秋雨 于 2020-8-5 09:03 编辑 5 p: t6 R5 p9 y5 z5 O+ E# A

    & X$ w: P) S; F. l$ W新人学习cadence,自己照着网上画了一张原理图,其中有一个ua741,七个引脚的器件,封装上网查说是用DIP8就可以,但生成PCB 时没有报错,只是报了一个警告,说是第8个引脚多余,摆放器件时,ua741对应的DIP8封装存在,但无法摆放。问老师傅,他说他也没遇见过,特此请教各位大佬,感谢各位伸出援手。
    9 X8 x+ _0 P  N7 ]9 o& c
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    2022-5-6 15:29
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    [LV.5]常住居民I

    11#
    发表于 2020-8-6 15:31 | 只看该作者
    用PCB Editor方式netin,要求原理图中的封装的脚位和dra的脚位一一对应,不能多也不能少
  • TA的每日心情
    无聊
    2021-3-4 15:31
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    [LV.4]偶尔看看III

    10#
     楼主| 发表于 2020-8-5 14:41 | 只看该作者
    5718366 发表于 2020-8-5 09:54, U) N) w7 d  U4 D
    建议查下规格书上的封装,dip8的封装也可以少一个焊盘脚,只有7个脚的,如果规格书上也是8个脚,可以在封装 ...
    . ]) ^- s2 C+ k4 N7 H; c7 [
    感谢,规格书是8脚,系统自带的原理图不对,已重画
    ( u, x0 C$ V  n: P
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    [LV.4]偶尔看看III

    9#
     楼主| 发表于 2020-8-5 14:37 | 只看该作者
    firstjing 发表于 2020-8-5 10:03% d; p) R! R* o/ n8 K) J
    看下规格书是几个脚,PCB的封装跟原理图的要对应上,规格书是7脚就是PCB封装用的不对,反之就是原理图的封 ...

    7 ]' D7 Q% I4 G$ ?4 Q( K9 e感谢,规格书是8脚,系统自带的原理图不对,已重画$ l& ?7 Q0 h0 z/ a3 F, m( L
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    2025-8-27 15:45
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    [LV.6]常住居民II

    8#
    发表于 2020-8-5 10:03 | 只看该作者
    看下规格书是几个脚,PCB的封装跟原理图的要对应上,规格书是7脚就是PCB封装用的不对,反之就是原理图的封装不对

    点评

    感谢,规格书是8脚,系统自带的原理图不对,已重画  详情 回复 发表于 2020-8-5 14:37

    该用户从未签到

    7#
    发表于 2020-8-5 09:54 | 只看该作者
    本帖最后由 5718366 于 2020-8-5 10:00 编辑
      G' V1 c" I% s3 X" E% N& i6 @) V9 o4 |; E6 I
    建议查下规格书上的封装,dip8的封装也可以少一个焊盘脚,只有7个脚的,如果规格书上也是8个脚,可以在封装编辑中,把第8脚设为mechanical焊盘(就是没有管脚号的那种): f2 y7 P& {0 y7 F' s

    点评

    感谢,规格书是8脚,系统自带的原理图不对,已重画  详情 回复 发表于 2020-8-5 14:41

    该用户从未签到

    6#
    发表于 2020-8-5 09:48 | 只看该作者
    顺便也来学习下、
  • TA的每日心情
    慵懒
    2023-1-31 15:12
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    [LV.9]以坛为家II

    5#
    发表于 2020-8-5 09:35 | 只看该作者
    夕照秋雨 发表于 2020-8-5 09:18- ?5 X6 ?8 U* ~
    这是cadence自带的原理图,我是要自己重新画一个吗?
    , q, {2 V# q8 I. G. u6 P- r
    对呢,刚好练习做库文件了。; y; N* _: ^$ |& s2 T
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    无聊
    2021-3-4 15:31
  • 签到天数: 17 天

    [LV.4]偶尔看看III

    4#
     楼主| 发表于 2020-8-5 09:18 | 只看该作者
    nene 发表于 2020-8-5 09:10
    % m3 F/ p  o2 T封装是8个脚,原理图也要有8个。

    + p! \( I7 E: Y: T2 k% I$ N# h/ |这是cadence自带的原理图,我是要自己重新画一个吗?

    点评

    对呢,刚好练习做库文件了。  详情 回复 发表于 2020-8-5 09:35
  • TA的每日心情
    慵懒
    2023-1-31 15:12
  • 签到天数: 491 天

    [LV.9]以坛为家II

    3#
    发表于 2020-8-5 09:10 | 只看该作者
    封装是8个脚,原理图也要有8个。

    点评

    这是cadence自带的原理图,我是要自己重新画一个吗?  详情 回复 发表于 2020-8-5 09:18
  • TA的每日心情
    郁闷
    2021-6-17 15:50
  • 签到天数: 1 天

    [LV.1]初来乍到

    2#
    发表于 2020-8-5 09:08 | 只看该作者
    原理图符号上是哪几个脚,你的PCB封装就得是那几个脚,这个必须一一对应。
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