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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › Cadence Allegro教程资料区 › allegro PCB 层与层的铜皮为何会避开过孔？
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allegro PCB 层与层的铜皮为何会避开过孔？

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xm_smallp

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1#
发表于 2016-2-17 09:54 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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如图，相同的网络，我在L1层和L3层使用了铜皮，并通过过孔连接，但是铜皮会自动避开过孔，4 [9 C' _8 l6 R+ H
不知在allegro中该如何设置，还请知道的朋友指导下，非常感谢！/ [" v3 J# Y2 n+ m; H
. K0 h; u  ^* u. B

! l: H% f! x  U$ J
! X1 B5 Z. o4 s( a" n* M

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xm_smallp

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3#
 楼主| 发表于 2016-2-19 17:02 | 只看该作者
fengyelyl 发表于 2016-2-19 10:364 F) y! R* g+ D) {
你可以把L1和L3的铜皮加大，包住过孔！
+ b1 ^1 f  \7 S0 e4 n
嗯嗯，谢谢！5 d# m0 g1 d/ b  _* @' U, a

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fengyelyl

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2#
发表于 2016-2-19 10:36 | 只看该作者
你可以把L1和L3的铜皮加大，包住过孔！

点评

xm_smallp
嗯嗯，谢谢！  详情 回复 发表于 2016-2-19 17:02

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