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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 求助，allegro层叠显示优先级设置
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求助，allegro层叠显示优先级设置

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zhuoxuan26

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#
发表于 2015-5-21 11:31 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式
5金币
求助，allegro层叠显示优先级设置
( f- a, O# ~1 \4 [2 ]5 C4 h# |  p: L铺铜后会出现丝印被挡住的现象，而又不想半透明铺铜，请问各位大大，allegro怎么调整层叠的显示优先级？
6 o/ C' Q) f+ Z* D' Z2 E) ~; L如图，allegro中铺铜后会挡住丝印层
4 y% J, c7 ?/ }9 S; t 9 @' ~) v- I- u/ K9 C$ w! g
: X" l! Y4 m/ H# l

2 p# x3 }$ B" O3 t# z而altium designer 或者protel里面不会出现这种问题，如图
% P  T, j+ d: X% h ' X( J- m/ V9 m2 L* O, r4 h

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dzkcool

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啥也不说了，直接上图：

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jacekysun

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6#
发表于 2015-6-2 09:12 | 只看该作者

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antoni2011

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5#
发表于 2015-6-2 08:51 | 只看该作者
看到……。顶了

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bingshuihuo

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4#
发表于 2015-6-1 22:34 | 只看该作者
支持一下~dzk版主V5~~

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辉辉辉辉

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3#
发表于 2015-5-22 08:32 | 只看该作者

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kinglangji
  • TA的每日心情
    衰
    2020-7-21 15:38

    • 签到天数: 21 天

    [LV.4]偶尔看看III
    2#
    发表于 2015-5-21 13:26 | 只看该作者
    支持一下~dzk版主V5~~

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    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    1#
    发表于 2015-5-21 11:31 | 只看该作者
    啥也不说了，直接上图：
    0 t  x+ j8 W: |4 U4 Y8 s. ^0 C
    * g. I8 D* o$ s2 _5 O* r

    评分

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    zhuoxuan26 + 1 很给力!

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