找回密码
 注册
关于网站域名变更的通知
查看: 1461|回复: 3
打印 上一主题 下一主题

请教走线的两个问题

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2008-9-4 20:54 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
1、Depending on the processor's pinout, it may be  difficult to route the processor bus signals on four tracking layer.
; _+ ], G# l3 O1 M" m! T/ ?2、They should be broken out on microstrip and should travel on the same layer for the entire route. One via is acceptable to connect to the CAP.
1 m+ B$ T/ p9 ?
, o, ~+ E% B" e其中第一句中我不明白tracking layer是什么意思?& q$ }8 t6 |8 o3 c7 o$ A7 a
第二句中的意思我没有完全明白,breakout的意思应该是中断的意思吧?在DDR2的时钟走线需要补偿电容/去耦电容的,但硬件手册说最多只能有一个过孔,那是怎么理解呢?如果要过孔的话,一般都是至少都要双数的吗?- [1 J* k% u& l8 I, |  c# U

4 y( ?8 D- R8 V  M! h* y/ [请教高手,先谢谢啦

该用户从未签到

4#
 楼主| 发表于 2008-9-5 21:26 | 只看该作者
' c4 H7 m) K* I' c6 B. N
- ?* a8 J0 K' [* X$ h
我原先的理解跟howsi的说法差不多
4 w. p- M, i# Y% n0 U; c2 i  x7 T1 u
只是不确定
" d7 [8 ~/ @  V7 {; D' x& o6 G* {' H4 X; J; `; D" B
谢谢两位

该用户从未签到

3#
发表于 2008-9-5 15:18 | 只看该作者
我是这样理解第二句话的:( G  v( K8 ~) L  {
他们在应该从微带线引出(也就是,如果芯片在TOP层,那么出pin的线首先从TOP层出来),然后,在板上的主要布线应走在同一层(注意,这句话并不是说主要布线必须跟出pin的线在同一层),在连接电容时,允许一个过孔。
/ q7 r! d3 v: o( C对于这种要求,通常有两种,一是出线后不换层,所有走线在表层走完;
3 d  L+ e' q! F% ~- m>----||--------------->
/ p4 b( m, P* k- y6 O/ T二是出线后马上换层(或连接电容后),在需要连接电容的时候,再次换到表层,然后走完剩下的。
2 q# s4 y9 R' h% \! |>----                             --||-->
" v6 x! v  @; ^( U        |                            |' g  t, j$ t% g: j9 i; {" z1 V
        --------------------
  • TA的每日心情
    开心
    2019-12-3 15:20
  • 签到天数: 3 天

    [LV.2]偶尔看看I

    2#
    发表于 2008-9-5 11:37 | 只看该作者
    (1)鉴于处理器的引脚排列,把所有总线信号布在4个走线层可能很困难。这里的“tracking layer”就是指布线层。/ w7 S7 l+ J( K; {! e) H. J
    (2)它们应该设计在微带线层,并且在同一层布线。到电容的连接,1个过孔是可以接受的,这里的1个孔是指电容每个pin上的连接允许1个孔。
    您需要登录后才可以回帖 登录 | 注册

    本版积分规则

    关闭

    推荐内容上一条 /1 下一条

    EDA365公众号

    关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

    GMT+8, 2025-11-22 21:47 , Processed in 0.140625 second(s), 25 queries , Gzip On.

    深圳市墨知创新科技有限公司

    地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

    快速回复 返回顶部 返回列表