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求DDR1 DDR2 DDR3布线规则设置

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  • TA的每日心情
    开心
    2025-7-24 15:33
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    [LV.1]初来乍到

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    1#
    发表于 2012-11-21 17:28 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    求DDR1 DDR2 DDR3布线规则设置:除了数据,地址线分为两组来进行绕等长设置,还有那些线需要进行分组,绕等长之间的公差又是根据什么来设的呢?时钟线将要跟哪些信号线归为一组?请大虾们指点。
  • TA的每日心情
    慵懒
    2025-2-10 15:39
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    [LV.4]偶尔看看III

    推荐
    发表于 2012-12-9 00:39 | 只看该作者
    我把ddr3歸類放上去ddr2ddr1只比ddr3少幾pin分類是一樣的
    ; J+ a! g% G; q4 v有分兩大類DQ跟AD其中DQ還可再分兩組
    1 d% K# m  b, H! [. a0 f# p- z8 c( M

    : }6 R& r# h- k$ m5 C( UAD                  DQ1        DQ2
    / S3 H9 a4 _: n% f, T/ t* x& ISD1_A0        SD_DM0        SD_DM28 m" |/ m9 B- n) Q' c8 g; V  d
    SD1_A1        SD_DQ0        SD_DQ16& t1 o" \' Y' l5 S! f
    SD1_A10        SD_DQ1        SD_DQ17
    3 u  s& c7 v5 r9 j, @SD1_A11        SD_DQ2        SD_DQ18, {* b4 F9 j' ]) @- G
    SD1_A12        SD_DQ3        SD_DQ19. z1 G" V# Q7 O  C) b
    SD1_A13        SD_DQ4        SD_DQ20/ `5 D; [, R% n+ T
    SD1_A14        SD_DQ5        SD_DQ21, B1 @; X# O  t7 n1 P) b* T/ q
    SD1_A15        SD_DQ6        SD_DQ227 W5 V- ]7 v( T) \- G" s9 z" c
    SD1_A2        SD_DQ7        SD_DQ237 S* n+ X/ D3 ~# a
    SD1_A3        SD_DQS0-        SD_DQS2-
    8 W2 R# {$ h- o. X' D5 G6 zSD1_A4        SD_DQS0+        SD_DQS2+* z; y5 C. ~! _
    SD1_A5        SD_DM1        SD_DM3
    7 c& b1 ?9 Q2 d# j1 SSD1_A6        SD_DQ8        SD_DQ24
    ' M( l" G- p5 z' q' ~- ISD1_A7        SD_DQ9        SD_DQ25# J0 t# I  C+ g0 J+ q9 f
    SD1_A8        SD_DQ10        SD_DQ26
    : t* I9 _6 a8 GSD1_A9        SD_DQ11        SD_DQ27
    9 _( |1 m0 w1 r4 Y9 DSD1_BA0        SD_DQ12        SD_DQ28( b  P1 H: k0 }8 x4 {2 n
    SD1_BA1        SD_DQ13        SD_DQ29
    $ I) y7 l: K0 MSD1_BA2        SD_DQ14        SD_DQ30: u* A  e6 H! v. H. O
    SD1_CAS#        SD_DQ15        SD_DQ31
    + y( u% g" O" q" iSD1_CKE        SD_DQS1-        SD_DQS3-' p6 y2 m  ?( U! S) q0 `, s
    SD_CLK0-        SD_DQS1+        SD_DQS3+7 K& x4 h8 J3 q. a: e
    SD_CLK0+                ' H! n" q* \- K- y% z" g* c2 W& d
    SD_CLK1-                + V) H) |9 g( Q  s5 g0 ?
    SD_CLK1+                * h# u( o+ y4 W, x! b" Y- w
    SD1_CS#               
    + e4 }, V4 r# N- lSD1_ODT               
    $ ?9 A+ A, i5 E2 ?3 ~SD1_RAS#               
    9 \$ n$ D' q  r* F2 FSD1_RESET#                + d  K* J: k9 W
    SD_STBC_CKE               
    " I/ E. U; }/ F1 BSD1_WE#                # M" d1 _- Y- }( q1 E

    该用户从未签到

    2#
    发表于 2012-11-21 19:12 | 只看该作者
    1、时钟线和地址线设为一组,并且等长要以时钟做参考# K' Z& M3 f7 [: ^8 a$ ?" }
    2、等长公差的话随着速率的提高要依次减少,ddr3的公差可以控制在15mil
    % l- a' L7 f. h! r2 `- i& J3、数据线和地址线要完全取分开,不能交叉走线
  • TA的每日心情
    开心
    2025-7-24 15:33
  • 签到天数: 1 天

    [LV.1]初来乍到

    3#
     楼主| 发表于 2012-11-22 11:20 | 只看该作者
    谢谢!还有一些控制线,如DM,DQ......,这些控制线是跟数据线还是地址线在一组呢?地址线要以什么信号线为参考呢?

    该用户从未签到

    4#
    发表于 2012-11-22 11:52 | 只看该作者
    love365 发表于 2012-11-22 11:20
    % J; E# C; Q) \+ M3 p0 b+ S9 V谢谢!还有一些控制线,如DM,DQ......,这些控制线是跟数据线还是地址线在一组呢?地址线要以什么信号线为参 ...
    . T4 ]+ R/ x- \+ ?) z+ ~
    dqs、dqm是要和数据线分为一组,其余的像we,cs之类的就归到地址组,地址组的等长以时钟线为参考

    该用户从未签到

    5#
    发表于 2012-11-27 23:04 | 只看该作者
    同求

    该用户从未签到

    6#
    发表于 2012-11-28 01:33 | 只看该作者
    tomyqg 发表于 2012-11-27 23:04 5 X: p( k' z4 v9 U
    同求
    : ?" a4 T$ o% g- n9 `. T
    多看看intel公司主板设计指引,上面分组讲得比较清楚

    该用户从未签到

    7#
    发表于 2012-11-28 11:00 | 只看该作者
    andyxie 发表于 2012-11-28 01:33 6 J% Q% |6 `$ u2 S6 p0 E% f
    多看看intel公司主板设计指引,上面分组讲得比较清楚
    6 p* ^% X$ u' Z8 h& V5 Q5 F
    andyxie  能发一份到  LEESE2002@163.COM 吗?谢谢!

    该用户从未签到

    8#
    发表于 2012-12-4 23:22 | 只看该作者
    新人学习!!

    该用户从未签到

    9#
    发表于 2012-12-6 08:34 | 只看该作者
    andyxie 发表于 2012-11-28 01:33
    4 g" W! ~$ m3 {4 @% R; |0 \多看看intel公司主板设计指引,上面分组讲得比较清楚
    * U+ s7 ?5 c/ r! n1 a
    求大侠也给我发一份吧。邮箱:237564880@qq.com

    该用户从未签到

    10#
    发表于 2012-12-6 08:48 | 只看该作者
    andyxie 发表于 2012-11-28 01:33
    - B+ D% h3 E3 R+ Q  v3 g5 A$ Y多看看intel公司主板设计指引,上面分组讲得比较清楚

    ! d1 e+ @$ e/ y- k& z, }' O0 h# a同求大侠发份,邮箱:675609122@qq.com,谢谢~!

    该用户从未签到

    11#
    发表于 2012-12-7 21:42 | 只看该作者
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